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1. (WO2011155047) SYSTÈME DE PROCESSEUR À PLUSIEURS CŒURS, PROCÉDÉ ET PROGRAMME DE RÉGULATION DE PUISSANCE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication : WO/2011/155047 N° de la demande internationale : PCT/JP2010/059876
Date de publication : 15.12.2011 Date de dépôt international : 10.06.2010
CIB :
G06F 9/50 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9
Dispositions pour la commande par programme, p.ex. unité de commande
06
utilisant un programme emmagasiné, c. à. d. utilisant une unité de stockage interne de l'équipement de traitement de données pour recevoir et conserver le programme
46
Dispositions pour la multiprogrammation
50
Allocation de ressources, p.ex. de l'unité centrale de traitement (UCT)
Déposants :
山内 宏真 YAMAUCHI, Hiromasa [JP/JP]; JP (UsOnly)
山下 浩一郎 YAMASHITA, Koichiro [JP/JP]; JP (UsOnly)
鈴木 貴久 SUZUKI, Takahisa [JP/JP]; JP (UsOnly)
栗原 康志 KURIHARA, Koji [JP/JP]; JP (UsOnly)
富士通株式会社 FUJITSU LIMITED [JP/JP]; 神奈川県川崎市中原区上小田中4丁目1番1号 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588, JP (AllExceptUS)
Inventeurs :
山内 宏真 YAMAUCHI, Hiromasa; JP
山下 浩一郎 YAMASHITA, Koichiro; JP
鈴木 貴久 SUZUKI, Takahisa; JP
栗原 康志 KURIHARA, Koji; JP
Mandataire :
酒井 昭徳 SAKAI, Akinori; 東京都千代田区霞が関3丁目2番5号 霞が関ビルディング20階 酒井総合特許事務所 A. SAKAI & ASSOCIATES, 20F, Kasumigaseki Building, 2-5, Kasumigaseki 3-chome, Chiyoda-ku, Tokyo 1006020, JP
Données relatives à la priorité :
Titre (EN) MULTI-CORE PROCESSOR SYSTEM, METHOD OF POWER CONTROL, AND POWER CONTROL PROGRAM
(FR) SYSTÈME DE PROCESSEUR À PLUSIEURS CŒURS, PROCÉDÉ ET PROGRAMME DE RÉGULATION DE PUISSANCE
(JA) マルチコアプロセッサシステム、電力制御方法、および電力制御プログラム
Abrégé :
(EN) When a piece of software that becomes the object to be migrated is an OS (operating system), CPU (#0) and CPU (#2) migrates the designated software from a CPU (#0) to a CPU (#2) by means of the migration unit (304) which is being run in the hypervisor (204). The CPU (#2) detects, by means of the detection unit (302), the status of the migration of the designated software from the CPU (#0) to the CPU (#2) which has a maximum throughput value that is less than that of the CPU (#0). After detection, when the status of the migration is detected by the detection unit (302), the CPU (#2) sets, by means of the setting unit (303), the throughput value of the CPU (#0) at the time of detection to be a throughput value that is lower than the throughput value before migration.
(FR) Quand un logiciel qui devient l'objet devant subir une migration est un OS (système d'exploitation), des UCT (#0) et (#2) font migrer le logiciel désigné d'une UCT (#0) à une UCT (#2) à l'aide de l'unité de migration (304) qui fonctionne dans l'hyperviseur (204). A l'aide de l'unité de détection (302), l'UCT (#2) détecte le statut de la migration du logiciel désigné de l'UCT (#0) à l'UCT (#2) qui possède une valeur de rendement maximum inférieure à celle de l'UCT (#0). Une fois la détection effectuée, quand l'unité de détection (302) détecte de statut de la migration, l'UCT (#2) paramètre, à l'aide de l'unité de paramétrage (303), la valeur de rendement de l'UCT (#0) au moment de la détection comme devant être une valeur de rendement inférieure à la valeur de rendement avant migration.
(JA)  CPU(#0)とCPU(#2)は、移行対象となるソフトウェアがOSの場合、ハイパーバイザ(204)で実行される移行部(304)によって、特定のソフトウェアをCPU(#0)からCPU(#2)へ移行させる。CPU(#2)は、検出部(302)によってCPU(#0)から、CPU(#0)より最大の処理能力値が低いCPU(#2)への、特定のソフトウェアの移行状態を検出する。検出後、CPU(#2)は、設定部(303)によって、検出部(302)にて移行状態を検出する場合、CPU(#0)の検出時点の処理能力値を、移行前よりも低い処理能力値に設定する。
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Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LR, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
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Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)