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1. WO2011067254 - ANALYSE DE SYNCHRONISATION

Numéro de publication WO/2011/067254
Date de publication 09.06.2011
N° de la demande internationale PCT/EP2010/068540
Date du dépôt international 30.11.2010
CIB
G06F 9/30 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9Dispositions pour la commande par programme, p.ex. unités de commande
06utilisant des programmes stockés, c. à d. utilisant un moyen de stockage interne à l'équipement de traitement de données pour recevoir ou conserver les programmes
30Dispositions pour exécuter des instructions machines, p.ex. décodage d'instructions
G06F 11/00 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
11Détection d'erreurs; Correction d'erreurs; Contrôle de fonctionnement
CPC
G06F 11/0757
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
11Error detection; Error correction; Monitoring
07Responding to the occurrence of a fault, e.g. fault tolerance
0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
0751Error or fault detection not based on redundancy
0754by exceeding limits
0757by exceeding a time limit, i.e. time-out, e.g. watchdogs
G06F 9/30076
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
30Arrangements for executing machine instructions, e.g. instruction decode
30003Arrangements for executing specific machine instructions
30076to perform miscellaneous control operations, e.g. NOP
Déposants
  • XMOS LTD [GB]/[GB] (AllExceptUS)
  • MAY, David, Michael [GB]/[GB] (UsOnly)
  • LAMBERTUS, Hendrik [NL]/[GB] (UsOnly)
Inventeurs
  • MAY, David, Michael
  • LAMBERTUS, Hendrik
Mandataires
  • VIRGINIA ROZANNE DRIVER
Données relatives à la priorité
12/628,70601.12.2009US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) TIMING ANALYSIS
(FR) ANALYSE DE SYNCHRONISATION
Abrégé
(EN)
One aspect of the present invention provides processor comprising: an execution unit arranged to execute a sequence of instructions each comprising a respective opcode; and a counter coupled to the execution unit and arranged to generate a periodically updated counter value during execution. The execution unit comprises logic configured to identify an opcode representing a trap-if-late instruction in said sequence, and in response to execute the trap-if-late instruction by comparing a target value to the counter value and generating an exception on condition that the counter value represents a time that is late relative to said target value. Another aspect provides a compiler for inserting trap-if-late instructions based on timing constraints in higher-level code.
(FR)
Un aspect de la présente invention concerne un processeur qui comprend : une unité d'exécution agencée pour exécuter une séquence d'instructions, les instructions comprenant chacune un code opération respectif; et un compteur couplé à l'unité d'exécution et agencé pour générer une valeur de compteur mise à jour de manière périodique au cours de l'exécution. L'unité d'exécution comprend une logique configurée pour identifier un code opération qui représente une instruction de piégeage en cas de retard dans ladite séquence et en réponse, exécuter l'instruction de piégeage en cas de retard en comparant une valeur cible à la valeur de compteur et en générant une exception si la valeur de compteur représente un temps qui est en retard par rapport à ladite valeur cible. Un autre aspect concerne un compilateur destiné à insérer des instructions de piégeage en cas de retard sur la base de contraintes de synchronisation dans un code de niveau plus élevé.
Également publié en tant que
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