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1. (WO2010093657) MICROCONTRÔLEUR À MÉMOIRE LINÉAIRE DANS UNE MÉMOIRE À BLOCS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2010/093657    N° de la demande internationale :    PCT/US2010/023701
Date de publication : 19.08.2010 Date de dépôt international : 10.02.2010
CIB :
G06F 9/30 (2006.01), G06F 12/06 (2006.01), G06F 9/318 (2006.01), G06F 9/35 (2006.01)
Déposants : MICROCHIP TECHNOLOGY INCORPORATED [US/US]; 2355 West Chandler Blvd. Chandler, AZ 85224-6199 (US) (Tous Sauf US).
LUNDSTRUM, Zeke, R. [US/US]; (US) (US Seulement).
DELPORT, Vivien [US/US]; (US) (US Seulement).
STEEDMAN, Sean [CA/US]; (US) (US Seulement).
JULICHER, Joseph [US/US]; (US) (US Seulement)
Inventeurs : LUNDSTRUM, Zeke, R.; (US).
DELPORT, Vivien; (US).
STEEDMAN, Sean; (US).
JULICHER, Joseph; (US)
Mandataire : SLAYDEN, Bruce, W., II; King & Spalding LLP 401 Congress Ave. Suite 3200 Austin, TX 78701 (US)
Données relatives à la priorité :
12/701,664 08.02.2010 US
61/151,754 11.02.2009 US
Titre (EN) MICROCONTROLLER WITH LINEAR MEMORY IN A BANKED MEMORY
(FR) MICROCONTRÔLEUR À MÉMOIRE LINÉAIRE DANS UNE MÉMOIRE À BLOCS
Abrégé : front page image
(EN)A microcontroller has a data memory divided into a plurality of memory banks, an address multiplexer for providing an address to the data memory, an instruction register providing a first partial address to a first input of the address multiplexer, a bank select register which is not mapped to the data memory for providing a second partial address to a the first input of the address multiplexer, and a plurality of special function registers mapped to the data memory, wherein the plurality of special function registers comprises an indirect access register coupled with a second input of the address multiplexer, and wherein the data memory comprises more than one memory bank of the plurality of memory banks that form a block of linear data memory to which no special function registers are mapped.
(FR)L'invention concerne un microcontrôleur qui comprend une mémoire de données divisée en une pluralité de blocs mémoire, un multiplexeur d'adresse pour fournir une adresse à la mémoire de données, un registre d'instruction fournissant une première adresse partielle à une première entrée du multiplexeur d'adresse, un registre de sélection de bloc qui n'est pas mappé sur la mémoire de données pour fournir une deuxième adresse partielle à la première entrée du multiplexeur d'adresse, et une pluralité de registres de fonction spécifique mappés sur la mémoire de données. La pluralité de registres de fonction spécifique comprend un registre d'accès indirect couplé à une deuxième entrée du multiplexeur d'adresse, et la mémoire de données comprend plus d'un bloc mémoire de la pluralité de blocs mémoire qui forment un bloc de mémoire de données linéaire sur lequel aucun registre de fonction spécifique n'est mappé.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CL, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PE, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TH, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, SM, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)