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1. (WO2010076666) PROCÉDÉ, SYSTÈME ET CIRCUIT INTÉGRÉ POUR AUTORISER L'ACCÈS À UN ÉLÉMENT DE MÉMOIRE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2010/076666    N° de la demande internationale :    PCT/IB2009/050010
Date de publication : 08.07.2010 Date de dépôt international : 05.01.2009
CIB :
G06F 21/31 (2013.01), G06F 21/79 (2013.01)
Déposants : FREESCALE SEMICONDUCTOR, INC. [US/US]; 6501 William Cannon Drive West Austin, Texas 78735 (US) (Tous Sauf US).
ROBERTSON, Alistair [GB/GB]; (GB) (US Seulement).
BEATTIE, Derek [GB/GB]; (GB) (US Seulement).
SCOBIE, James Andrew Collier [GB/GB]; (GB) (US Seulement)
Inventeurs : ROBERTSON, Alistair; (GB).
BEATTIE, Derek; (GB).
SCOBIE, James Andrew Collier; (GB)
Données relatives à la priorité :
Titre (EN) METHOD, SYSTEM AND INTEGRATED CIRCUIT FOR ENABLING ACCESS TO A MEMORY ELEMENT
(FR) PROCÉDÉ, SYSTÈME ET CIRCUIT INTÉGRÉ POUR AUTORISER L'ACCÈS À UN ÉLÉMENT DE MÉMOIRE
Abrégé : front page image
(EN)A system (200, 300) comprises signal processing logic (210, 310) that is operably coupled to at least one memory element (220, 320) and is arranged to enable access to the at least one memory element (220, 320). The signal processing logic (210, 310) is arranged to receive a security key (235, 335), generate a system key (255, 355) using the received security key (235, 335) and a system specific seed (260, 360), perform a comparison of the generated system key to a reference key (227, 327) stored in an area of memory (225, 325) of the at least one memory element. The signal processing logic (210, 310) is also arranged to configure a level of access to the at least one memory element (220, 320) based at least partly on the comparison of the generated system key (255, 355) to the reference key (227, 327) stored in memory (225, 325).
(FR)L'invention concerne un système (200, 300) comportant une logique (210, 310) de traitement de signal couplée fonctionnellement à au moins un élément (220, 320) de mémoire et prévue pour autoriser l'accès à l'élément ou aux éléments (220, 320) de mémoire. La logique (210, 310) de traitement de signal est prévue pour recevoir une clé (235, 335) de sécurité, générer une clé système (255, 355) en utilisant la clé (235, 335) de sécurité reçue et une semence (260, 360) spécifique au système, effectuer une comparaison de la clé système générée à une clé (227, 327) de référence stockée dans une zone de mémoire (225, 325) de l'élément ou des éléments de mémoire. La logique (210, 310) de traitement de signal est également prévue pour configurer un niveau d'accès à l'élément ou aux éléments (220, 320) de mémoire en se basant au moins en partie sur la comparaison de la clé système (255, 355) générée à la clé (227, 327) de référence stockée dans la mémoire (225, 325).
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)