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1. (WO2009141612) AMÉLIORATIONS CONCERNANT UNE ARCHITECTURE DE TRAITEMENT DE DONNÉES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2009/141612    N° de la demande internationale :    PCT/GB2009/001274
Date de publication : 26.11.2009 Date de dépôt international : 20.05.2009
CIB :
G06F 15/80 (2006.01)
Déposants : ASPEX SEMICONDUCTOR LIMITED [GB/GB]; Aspex House 44-45 Oxford Street High Wycombe Buckinghamshire HP11 2DJ (GB) (Tous Sauf US).
WHITAKER, Martin [GB/GB]; (GB) (US Seulement).
LANCASTER, John [AU/AU]; (GB) (US Seulement)
Inventeurs : WHITAKER, Martin; (GB).
LANCASTER, John; (GB)
Mandataire : ELKINER, Kaya; Keltie Fleet Place House 2 Fleet Place London EC4M 7ET (GB)
Données relatives à la priorité :
0809192.8 20.05.2008 GB
Titre (EN) IMPROVEMENTS RELATING TO DATA PROCESSING ARCHITECTURE
(FR) AMÉLIORATIONS CONCERNANT UNE ARCHITECTURE DE TRAITEMENT DE DONNÉES
Abrégé : front page image
(EN)A parallel processor is described which is operated in a SIMD manner. The processor comprises: a plurality of processing elements connected in a string and grouped into a plurality of processing units, wherein each processing unit comprises a plurality of processing elements which each have direct interconnections with all of the other processing elements within the respective processing unit, the interconnections enabling data transfer between any two elements within a unit to be effected in a single clock cycle.
(FR)L’invention concerne un processeur parallèle qui est mis en œuvre d'une manière SIMD. Le processeur comprend : une pluralité d'éléments de traitement connectés en chaîne et groupés en une pluralité d'unités de traitement, chaque unité de traitement comprenant une pluralité d'éléments de traitement qui ont chacun des interconnexions directes avec tous les autres éléments de traitement dans l'unité de traitement respective, les interconnexions permettant qu'un transfert de données entre deux éléments quelconques dans une unité soit effectué en un seul cycle d'horloge.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)