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1. (WO2009114289) SYSTÈME ET MÉTHODE DE REMISE SÉLECTIVE DU RÉSULTAT D'UNE INSTRUCTION EXÉCUTÉE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2009/114289    N° de la demande internationale :    PCT/US2009/035372
Date de publication : 17.09.2009 Date de dépôt international : 27.02.2009
CIB :
G06F 9/38 (2006.01)
Déposants : QUALCOMM INCORPORATED [US/US]; Attn: International Ip Administration 5775 Morehouse Drive San Diego, CA 92121 (US) (Tous Sauf US).
CODRESCU, Lucian [US/US]; (US) (US Seulement).
LESTER, Robert, A. [US/US]; (US) (US Seulement).
TABONY, Charles, J. [US/US]; (US) (US Seulement).
PLONDKE, Erich, J. [US/US]; (US) (US Seulement).
ZENG, Mao [CA/US]; (US) (US Seulement).
VENKUMAHANTI, Suresh, K. [IN/US]; (US) (US Seulement).
INGLE, Ajay, A. [US/US]; (US) (US Seulement)
Inventeurs : CODRESCU, Lucian; (US).
LESTER, Robert, A.; (US).
TABONY, Charles, J.; (US).
PLONDKE, Erich, J.; (US).
ZENG, Mao; (US).
VENKUMAHANTI, Suresh, K.; (US).
INGLE, Ajay, A.; (US)
Mandataire : TALPALATSKY, Sam; (US)
Données relatives à la priorité :
12/045,825 11.03.2008 US
Titre (EN) SYSTEM AND METHOD OF SELECTIVELY COMMITTING A RESULT OF AN EXECUTED INSTRUCTION
(FR) SYSTÈME ET MÉTHODE DE REMISE SÉLECTIVE DU RÉSULTAT D'UNE INSTRUCTION EXÉCUTÉE
Abrégé : front page image
(EN)In a particular embodiment, a method is disclosed that includes receiving an instruction packet including a first instruction and a second instruction that is dependent on the first instruction at a processor having a plurality of parallel execution pipelines, including a first execution pipeline and a second execution pipeline. The method further includes executing in parallel at least a portion of the first instruction and at least a portion of the second instruction. The method also includes selectively committing a second result of executing the at least a portion of the second instruction with the second execution pipeline based on a first result related to execution of the first instruction with the first execution pipeline.
(FR)L'invention porte sur l'exécution particulière d'une méthode consistant: à transmettre un paquet d'instructions contenant une première instruction, et une deuxième instruction dépendant de la première, à un processeur comportant plusieurs pipelines d'exécution parallèles dont un premier et un deuxième; à exécuter en parallèle au moins une partie de la première instruction et au moins une partie de la deuxième instruction; puis à remettre sélectivement un deuxième résultat d'exécution de la première partie de la deuxième instruction dans le deuxième pipeline sur la base du premier résultat d'exécution de la première instruction par le premier pipeline.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)