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1. (WO2009107462) PROCESSEUR POUR EXÉCUTER UN FLUX D'INSTRUCTIONS À BAS COÛT, PROCÉDÉ POUR L'EXÉCUTION ET PROGRAMME POUR L'EXÉCUTION
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2009/107462    N° de la demande internationale :    PCT/JP2009/051753
Date de publication : 03.09.2009 Date de dépôt international : 03.02.2009
CIB :
G06F 9/38 (2006.01), G06F 9/30 (2006.01)
Déposants : NEC CORPORATION [JP/JP]; 7-1, Shiba 5-chome, Minato-ku, Tokyo 1080014 (JP) (Tous Sauf US).
NOMOTO, Shohei [JP/JP]; (JP) (US Seulement)
Inventeurs : NOMOTO, Shohei; (JP)
Mandataire : YAMASHITA, Johei; YAMASHITA & ASSOCIATES, Landic Toranomon Bldg., 7-10, Toranomon 3-chome, Minato-ku, Tokyo 1050001 (JP)
Données relatives à la priorité :
2008-044274 26.02.2008 JP
Titre (EN) PROCESSOR FOR EXECUTING INSTRUCTION STREAM AT LOW COST, METHOD FOR THE EXECUTION, AND PROGRAM FOR THE EXECUTION
(FR) PROCESSEUR POUR EXÉCUTER UN FLUX D'INSTRUCTIONS À BAS COÛT, PROCÉDÉ POUR L'EXÉCUTION ET PROGRAMME POUR L'EXÉCUTION
(JA) 低コストに複数命令流を実行するプロセッサ、その方法及びそのプログラム
Abrégé : front page image
(EN)A VLIW processor for executing very long instruction words constituted of instructions so as to execute instruction streams at low cost. The processor for executing very long instruction words constituted of instructions simultaneously fetches very long instruction words constituted of at most M instruction streams from N (N<M) instruction caches including memory banks storing the very long instruction words of M instruction streams. The following processing may be performed. An instruction stream priority is given to each instruction stream, and a memory bank used for each instruction stream is specified from among all the memory banks according to number-of-banks information representing the number of memory banks used for the instruction streams and the instruction addresses of the instruction streams. When instruction streams use the same memory bank, the memory bank used for the instruction streams is determined in order of the instruction stream priority. The instruction addresses of the instruction streams are supplied to the memory bank.
(FR)L'invention porte sur un processeur VLIW pour exécuter de très longs mots d'instruction (VLIW) constitués d'instructions de façon à exécuter des flux d'instructions à bas coût. Le processeur pour exécuter de très longs mots d'instruction constitués d'instructions, extrait simultanément de très longs mots d'instruction constitués au plus de M flux d'instructions à partir de N caches d'instruction (N < M) incluant des blocs mémoire stockant les très longs mots d'instruction de M flux d'instructions. Le traitement suivant peut être effectué. Une priorité de flux d'instructions est donnée à chaque flux d'instructions, et un bloc mémoire utilisé pour chaque flux d'instructions est spécifié parmi tous les blocs mémoire selon des informations de nombre de blocs représentant le nombre de blocs mémoire utilisés pour les flux d'instructions et les adresses d'instruction des flux d'instructions. Lorsque les flux d'instructions utilisent le même bloc mémoire, le bloc mémoire utilisé pour les flux d'instructions est déterminé dans l'ordre de la priorité de flux d'instructions. Les adresses d'instruction des flux d'instructions sont fournies au bloc mémoire.
(JA) 複数個の命令からなる超長命令語を実行するVLIWプロセッサにおいて、低コストで、複数の命令流の実行を可能とする。  複数個の命令から構成される超長命令語を実行するプロセッサにおいて、M個の命令流の前記超長命令語を格納する複数のメモリバンクを備えるN(N<M)個の命令キャッシュから、最大M個の命令流の前記超長命令語を同時にフェッチする。また、各命令流に命令流優先度を設定し、各命令流が使用するメモリバンクの数を示すバンク数情報と、各命令流の命令アドレスとに基づき、各命令流が使用するメモリバンクを全メモリバンクの中から特定し、複数命令流が同一メモリバンクを使用する場合には、前記命令流優先度に基づき、優先度の高い命令流から順に、命令流が使用するメモリバンクを決定し、当該命令流の命令アドレスを当該メモリバンクに供給するようにしてもよい。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MK, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)