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1. (WO2009086722) ARCHITECTURE DE STOCKAGE PARTAGÉ À COUPLAGE SERRÉ DE MICROPROCESSEURS EXTENSIBLES À DOUBLE CORPS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2009/086722    N° de la demande internationale :    PCT/CN2008/001834
Date de publication : 16.07.2009 Date de dépôt international : 03.11.2008
CIB :
G06F 15/167 (2006.01)
Déposants : LANGCHAO ELECTRONIC INFORMATION INDUSTRY CO., LTD [CN/CN]; 224 Shanda Road, Jinan, Shandong 250014 (CN) (Tous Sauf US).
HU, Leijun [CN/CN]; (CN) (US Seulement).
DOU, Yong [CN/CN]; (CN) (US Seulement).
LIU, Guangming [CN/CN]; (CN) (US Seulement).
WANG, Endong [CN/CN]; (CN) (US Seulement).
LIAO, Xiangke [CN/CN]; (CN) (US Seulement).
LUO, Jun [CN/CN]; (CN) (US Seulement).
YIN, Hongwei [CN/CN]; (CN) (US Seulement).
WU, Qingbo [CN/CN]; (CN) (US Seulement).
WANG, Yongwen [CN/CN]; (CN) (US Seulement).
WANG, Shouhao [CN/CN]; (CN) (US Seulement).
HUANG, Jiaming [CN/CN]; (CN) (US Seulement).
ZHAO, Jizhi [CN/CN]; (CN) (US Seulement).
ZHENG, Yi [CN/CN]; (CN) (US Seulement)
Inventeurs : HU, Leijun; (CN).
DOU, Yong; (CN).
LIU, Guangming; (CN).
WANG, Endong; (CN).
LIAO, Xiangke; (CN).
LUO, Jun; (CN).
YIN, Hongwei; (CN).
WU, Qingbo; (CN).
WANG, Yongwen; (CN).
WANG, Shouhao; (CN).
HUANG, Jiaming; (CN).
ZHAO, Jizhi; (CN).
ZHENG, Yi; (CN)
Mandataire : TEE & HOWE INTELLECTUAL PROPERTY ATTORNEYS; LUO, Jianmin, Room 718, Beijing Capital Times Square, 88 Xichang'an Avenue, Xicheng District, Beijing 100031 (CN)
Données relatives à la priorité :
200810013718.9 07.01.2008 CN
Titre (EN) CLOSE-COUPLING SHARED STORAGE ARCHITECTURE OF DOUBLE-WING EXPANDABLE MULTIPROCESSOR
(FR) ARCHITECTURE DE STOCKAGE PARTAGÉ À COUPLAGE SERRÉ DE MICROPROCESSEURS EXTENSIBLES À DOUBLE CORPS
(ZH) 一种双翼可扩展多处理器紧耦合共享存储器体系结构
Abrégé : front page image
(EN)A close-coupling shared storage architecture of a double-wing expandable multiprocessor is provided in the close-coupling shared storage architecture with p processors scale, comprises: j processor modules PM; wherein, each processor module is formed by i processes C which are coupled and cross-jointed, only one link of each processor is directly connected with a node controller NC; each processor module PM comprises two pairing node controllers NC, and each node controller NC is connected with the processor through m links and is connected with the interconnect network through n links; the interconnect network comprises two groups, and eachgroup thereof comprises k cross switch route chips NR with q ports. By adopting the connection method above, the close-coupling shared storage architecture of the expandable double-vane multiprocessor is formed. On the premise that the processor scale is kept expandable, the balance between the process bandwidth and the network bandwidth is realized, and the lower average delay of the interconnect network is kept at the same time.
(FR)L'invention porte sur une architecture de stockage partagé à couplage serré d'un microprocesseur extensible à double corps à échelle p de processeur, comprenant: j modules de processeur (PM) formés chacun par I processus C couplés et interconnectés, et dont seule une liaison est directement reliée à un contrôleur de noeud (NC); chaque module de processeur PM comprend deux contrôleurs de noeud (NC) appariés, reliés chacun au processeur via m liens et reliés chacun au réseau interconnecté via n liens; le réseau interconnecté comprend deux groupes comprenant chacun k puces à q ports de commutation de route. La susdite méthode de connexion permet de former ladite architecture. A condition que l'échelle de processeur reste extensible, l'équilibre entre la largeur de bande de processus et la largeur de bande de réseau est réalisé et le retard moyen inférieur du réseau interconnecté est en même temps maintenu.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, ST, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : chinois (ZH)
Langue de dépôt : chinois (ZH)