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1. (WO2008126657) CONTRÔLEUR D'ACCÈS DIRECT À LA MÉMOIRE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/126657    N° de la demande internationale :    PCT/JP2008/055292
Date de publication : 23.10.2008 Date de dépôt international : 21.03.2008
Demande présentée en vertu du Chapitre 2 :    21.11.2008    
CIB :
G06F 13/28 (2006.01)
Déposants : RENESAS TECHNOLOGY CORP. [JP/JP]; 6-2, Otemachi 2-chome, Chiyoda-ku, Tokyo 1000004 (JP) (Tous Sauf US).
NAGAI, Yasushi [JP/JP]; (JP) (US Seulement).
NAKAGOE, Hiroshi [JP/JP]; (JP) (US Seulement).
TAIRA, Shigeki [JP/JP]; (JP) (US Seulement)
Inventeurs : NAGAI, Yasushi; (JP).
NAKAGOE, Hiroshi; (JP).
TAIRA, Shigeki; (JP)
Mandataire : TSUTSUI, Yamato; Tsutsui & Associates, 6th Floor, Kokusai Chusei Kaikan, 14, Gobancho, Chiyoda-ku, Tokyo 1020076 (JP)
Données relatives à la priorité :
2007-103509 11.04.2007 JP
Titre (EN) DMA CONTROLLER
(FR) CONTRÔLEUR D'ACCÈS DIRECT À LA MÉMOIRE
(JA) DMAコントローラ
Abrégé : front page image
(EN)Provided is a DMA controller which can realize real time control of DMA transfer associated with a peripheral device which operates periodically at a low cost and with a low power consumption. The DMA controller includes: a counter which counts time; a counter comparator which compares a value of the counter to a counter value indicating a scheduled time of the DMA transfer; a peripheral device read unit which reads a register of a peripheral device and acquires its state; and a state comparator which compares the value of the peripheral device register to the DMA transfer start condition. When triggered by a comparison result obtained by the counter comparator, the DMA controller updates the counter value indicating the scheduled time of the DMA transfer, reads the register of the peripheral device, performs a comparison by using the state comparator, and performs DMA transfer if the comparison result obtained by the state comparator satisfies a condition according to a specified order.
(FR)L'invention concerne un contrôleur d'accès direct à la mémoire (DMA) qui peut permettre d'obtenir une commande en temps réel d'un transfert DMA associé à un dispositif périphérique qui fonctionne de manière périodique à faible coût et avec une faible consommation de puissance. Le contrôleur DMA comprend : un compteur qui compte le temps ; un comparateur de compteur qui compare une valeur du compteur à une valeur de compteur indiquant un temps programmé du transfert DMA ; une unité de lecture du dispositif périphérique qui lit un registre d'un dispositif périphérique et acquiert son état ; et un comparateur d'état qui compare la valeur du registre de dispositif périphérique à une condition de début de transfert DMA. Lorsqu'il est déclenché par un résultat de comparaison obtenu par le comparateur de compteur, le contrôleur DMA met à jour la valeur de compteur indiquant le temps programmé du transfert DMA, lit le registre du dispositif périphérique, réalise une comparaison par l'utilisation du comparateur d'état, et réalise un transfert DMA si le résultat de comparaison obtenu par le comparateur d'état satisfait une condition conformément à un ordre spécifié.
(JA) 周期的に動作する周辺装置にかかわるDMA転送のリアルタイム制御を低コスト・低消費電力で実現するDMAコントローラである。本発明の代表的な実施の形態は、時間を計測するためのカウンタと、該カウンタの値とDMA転送の予定時間を示すカウンタ値とを比較するカウンタ比較器と、周辺装置のレジスタをリードして状態を取得する周辺装置リード部と、前記周辺装置のレジスタの値とDMA転送の開始条件とを比較する状態比較器とを有するDMAコントローラであって、前記カウンタ比較器による比較結果の成立をトリガに、指定された順序に従い、前記DMA転送の予定時間を示すカウンタ値の更新と、前記周辺装置のレジスタのリードと、前記状態比較器による比較と、前記状態比較器による比較結果の成立を条件としたDMA転送とを実行するものである。
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)