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1. (WO2008124921) DÉTERMINATION DE LA CONVERGENCE ET ESTIMATION DU FACTEUR D'ÉCHELLE SUR LA BASE DE L'ACTIVITÉ DE COMMUTATION DÉTECTÉE OU DE LA CONSOMMATION D'ÉNERGIE MESURÉE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/124921    N° de la demande internationale :    PCT/CA2008/000671
Date de publication : 23.10.2008 Date de dépôt international : 11.04.2008
CIB :
H03K 19/00 (2006.01), G05B 19/05 (2006.01)
Déposants : THE ROYAL INSTITUTION FOR THE ADVANCEMENT OF LEARNING/McGILL UNIVERSITY [CA/CA]; 1555 Peel Street, 11th Floor, Montreal, Quebec H3A 3L8 (CA) (Tous Sauf US).
GROSS, Warren, J. [CA/CA]; (CA) (US Seulement).
MANNOR, Shie [IL/CA]; (CA) (US Seulement)
Inventeurs : GROSS, Warren, J.; (CA).
MANNOR, Shie; (CA)
Mandataire : FREEDMAN, Gordon; Freedman & Associates, 117 Centrepointe Drive, Suite 350, Nepean, Ontario K2G 5X3 (CA)
Données relatives à la priorité :
60/907,606 11.04.2007 US
Titre (EN) CONVERGENCE DETERMINATION AND SCALING FACTOR ESTIMATION BASED ON SENSED SWITCHING ACTIVITY OR MEASURED POWER CONSUMPTION
(FR) DÉTERMINATION DE LA CONVERGENCE ET ESTIMATION DU FACTEUR D'ÉCHELLE SUR LA BASE DE L'ACTIVITÉ DE COMMUTATION DÉTECTÉE OU DE LA CONSOMMATION D'ÉNERGIE MESURÉE
Abrégé : front page image
(EN)A method and system for determining convergence of iterative processes and estimating a scaling factor in decoding processes based on switching activity of the logic circuitry are provided. During execution of an iterative process using logic circuitry comprising logic gates switching activity of a plurality of the logic gates is sensed to determine switching data indicative of a total switching activity of the plurality of the logic gates. The iterative process is iterated using the logic circuitry until convergence is indicated by the switching data. Similarly, a scaling factor for use in decoding processes is determined based on the switching data.
(FR)La présente invention concerne un procédé et un système destinés à déterminer la convergence de processus itératifs et à estimer un facteur d'échelle dans des processus de décodage sur la base de l'activité de commutation du circuit logique. Pendant l'exécution d'un processus itératif utilisant le circuit logique comprenant des portes logiques, l'activité de commutation d'une pluralité de portes logiques est détectée pour déterminer des données de commutations indiquant une activité de commutation totale de la pluralité des portes logiques. Le processus itératif est répété en utilisant le circuit logique jusqu'à ce que la convergence soit indiquée par les données de commutation. De même, un facteur d'échelle à utiliser dans les processus de décodage est déterminé à partir des données de commutation.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)