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1. (WO2008121559) SYSTÈME COMPRENANT DES MODULES DE MÉMOIRE HIÉRARCHIQUES INTÉGRANT DIFFÉRENTS TYPES DE DISPOSITIFS DE MÉMOIRE SUR CIRCUITS INTÉGRÉS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/121559    N° de la demande internationale :    PCT/US2008/057471
Date de publication : 09.10.2008 Date de dépôt international : 19.03.2008
CIB :
G06F 12/08 (2006.01), G06F 13/16 (2006.01)
Déposants : RAMBUS INCORPORATED [US/US]; 4440 El Camino Real, Los Altos, CA 94022 (US) (Tous Sauf US).
HAMPEL, Craig [US/US]; (US) (US Seulement).
HOROWITZ, Mark [US/US]; (US) (US Seulement)
Inventeurs : HAMPEL, Craig; (US).
HOROWITZ, Mark; (US)
Mandataire : DENIRO, Kirk, J.; Vierra Magen Marcus & Deniro, Llp, 575 Market Street, Suite 2500, San Francisco, CA 94105 (US)
Données relatives à la priorité :
60/909,359 30.03.2007 US
Titre (EN) SYSTEM INCLUDING HIERARCHICAL MEMORY MODULES HAVING DIFFERENT TYPES OF INTEGRATED CIRCUIT MEMORY DEVICES
(FR) SYSTÈME COMPRENANT DES MODULES DE MÉMOIRE HIÉRARCHIQUES INTÉGRANT DIFFÉRENTS TYPES DE DISPOSITIFS DE MÉMOIRE SUR CIRCUITS INTÉGRÉS
Abrégé : front page image
(EN)A memory system is disclosed comprising a memory controller and a first set of volatile memory devices defining a first memory hierarchy. The first set of volatile memory devices are disposed on at least one first memory module, which is coupled to the memory controller in a daisy-chained configuration. A first integrated circuit buffer device is included on the module. The system has a second set of nonvolatile memory devices defining a second memory hierarchy. The second set of nonvolatile memory devices are disposed on at least one second memory module, which is coupled to the at least one first memory module in a daisy-chained configuration. The second module includes a second integrated circuit buffer device. The system is configured such that signals transmitted between the memory controller and the second memory hierarchy pass through the first memory hierarchy.
(FR)Système de mémoire comprenant un contrôleur mémoire et un premier ensemble de dispositifs de mémoire volatile et définissant une première hiérarchie de mémoires. Le premier ensemble de dispositifs de mémoire volatile est disposé sur au moins un premier module de mémoire, qui est couplé au contrôleur mémoire selon une configuration en série. Un premier dispositif de mémoire tampon sur circuit intégré est inclus dans ce module. Ce système comporte un second ensemble de dispositifs de mémoire non volatile définissant une seconde hiérarchie de mémoires. Ce second ensemble de dispositifs de mémoire non volatile est disposé sur au moins un second module de mémoire, qui est couplé au(x) premier(s) module(s) de mémoire selon une configuration en série. Le second module comprend un second dispositif de mémoire tampon sur circuit intégré. Le système est configuré de telle sorte que les signaux transmis entre le contrôleur de mémoire et la seconde hiérarchie de mémoires traversent la première hiérarchie de mémoires.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)