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1. (WO2008117111) INTERFACE DE COMMANDE DE MÉMOIRE FLASH
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/117111    N° de la demande internationale :    PCT/IB2007/004473
Date de publication : 02.10.2008 Date de dépôt international : 02.10.2007
CIB :
G06F 13/42 (2006.01)
Déposants : MARVELL WORLD TRADE LTD. [BB/BB]; L'Horizon, Gunsite Road, Brittons Hill, St. Michael 14027 (BB) (Tous Sauf US).
URABE, Masayuki [JP/JP]; (JP) (US Seulement)
Inventeurs : URABE, Masayuki; (JP)
Données relatives à la priorité :
60/828,144 04.10.2006 US
11/866,167 02.10.2007 US
Titre (EN) FLASH MEMORY CONTROL INTERFACE
(FR) INTERFACE DE COMMANDE DE MÉMOIRE FLASH
Abrégé : front page image
(EN)Interfaces, arrangements, and methods for controlling flash memory devices in multiple device systems without increasing a pin count are disclosed. In one embodiment, a memory controller can include a first interface to communicate with a host, and a second interface to communicate with a plurality of flash memory devices, where the second interface can include: a configuration terminal to transmit an instruction to the plurality of flash memory devices and to receive device identification information; a command control terminal to transmit a command timing signal to the plurality of flash memory devices; a clock terminal to transmit a clock signal to the plurality of flash memory devices; a read command terminal to receive a read command from the plurality of flash memory devices; and a first plurality of data input/output (I/O) terminals to transmit data to and receive data from the plurality of flash memory devices.
(FR)L'invention concerne des interfaces, des agencements et des procédés pour commander des dispositifs de mémoire flash dans des systèmes à multiples dispositifs sans augmenter un nombre de broches. Dans un mode de réalisation, un contrôleur de mémoire peut comprendre une première interface pour communiquer avec un hôte et une seconde interface pour communiquer avec une pluralité de dispositifs de mémoire flash, la seconde interface pouvant comprendre : une borne de configuration pour transmettre une instruction à la pluralité de dispositifs de mémoire flash et pour recevoir des informations d'identification de dispositif; une borne de commande d'instruction pour transmettre un signal de temporisation d'instruction à la pluralité de dispositifs de mémoire flash; une borne d'horloge pour transmettre un signal d'horloge à la pluralité de dispositifs de mémoire flash; une borne d'instruction de lecture pour recevoir une instruction de lecture en provenance de la pluralité de dispositifs de mémoire flash; et une première pluralité de bornes d'entrée/sortie de données (E/S) pour transmettre des données et pour recevoir des données à partir de la pluralité de dispositifs de mémoire flash.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)