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1. (WO2008088946) SYSTÈME D'ÉTABLISSEMENT D'UNE PROTECTION LATENTE D'ORDRES DE TRANSACTIONS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/088946    N° de la demande internationale :    PCT/US2008/050250
Date de publication : 24.07.2008 Date de dépôt international : 04.01.2008
CIB :
G06Q 40/00 (2012.01), G06Q 40/04 (2012.01)
Déposants : BGC PARTNERS, L.P. [US/US]; 111 East 58th Street, New York, NY 10022 (US) (Tous Sauf US).
NOVIELLO, Joseph, C. [US/US]; (US) (US Seulement).
WESTON, Brian, Alexander [US/US]; (US) (US Seulement).
CAPUANO, John, Robert [US/US]; (US) (US Seulement).
BARTKO, Peter [US/US]; (US) (US Seulement)
Inventeurs : NOVIELLO, Joseph, C.; (US).
WESTON, Brian, Alexander; (US).
CAPUANO, John, Robert; (US).
BARTKO, Peter; (US)
Mandataire : BHAVSAR, Samir, A.; Baker Botts L.L.P., 2001 Ross Avenue, Suite 600, Dallas, TX 75201 (US)
Données relatives à la priorité :
11/623,734 16.01.2007 US
Titre (EN) SYSTEM FOR PROVIDING LATENCY PROTECTION FOR TRADING ORDERS
(FR) SYSTÈME D'ÉTABLISSEMENT D'UNE PROTECTION LATENTE D'ORDRES DE TRANSACTIONS
Abrégé : front page image
(EN)A system for managing trading orders comprises a memory operable to store an order associated with a first price. The system further comprises a processor communicatively coupled to the memory and operable to identify a latency value. The processor is further operable to receive a counterorder and to identify a potential trade associated with the order and the counterorder, the potential trade based at least in part on the first price. If the latency value satisfies a configurable condition, the processor is further operable to initiate a configurable period of time. If the potential trade is not valid upon expiration of the configurable period, the processor is further operable to prevent the execution of the potential trade.
(FR)Un système permettant de gérer des ordres de transactions comprend une mémoire permettant de stocker un ordre associé à un premier prix. Le système comprend en outre un processeur couplé en communication avec la mémoire et capable d'identifier une valeur de latence. Le processeur peut également servir à recevoir un contre-ordre et à identifier une opération potentielle associée à l'ordre et au contre-ordre, l'opération potentielle étant au moins en partie basée sur le premier prix. Si la valeur de latence satisfait une condition programmable, le processeur est en outre capable de déclencher une période de temps configurable. Si l'opération potentielle n'est pas valable à l'expiration de la période configurable, le processeur est en outre capable d'empêcher l'exécution de l'opération potentielle.
États désignés : AE, AG, AL, AM, AO, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, NO, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)