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1. (WO2008063383) SYSTÈMES ET PROCÉDÉS PERMETTANT DE FORMER DES RÉSEAUX NEURONAUX RECONFIGURABLES ET FAISANT APPEL À DES FPGA DOTÉS DE ROUTEURS DE PAQUETS
Dernières données bibliographiques dont dispose le Bureau international

N° de publication : WO/2008/063383 N° de la demande internationale : PCT/US2007/023240
Date de publication : 29.05.2008 Date de dépôt international : 01.11.2007
CIB :
G06F 15/173 (2006.01)
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
15
Calculateurs numériques en général; Équipement de traitement de données en général
16
Associations de deux ou plusieurs calculateurs numériques comportant chacun au moins une unité arithmétique, une unité programme et un registre, p.ex. pour le traitement simultané de plusieurs programmes
163
Communication entre processeurs
173
utilisant un réseau d'interconnexion, p.ex. matriciel, de réarrangement, pyramidal, en étoile ou ramifié
Déposants :
L-3 COMMUNICATIONS INTEGRATED SYSTEMS L.P. [US/US]; 10001 Jack Finney Blvd. Greenville, TX 75402, US (AllExceptUS)
YANCEY, Jerry, W. [US/US]; US (UsOnly)
Inventeurs :
YANCEY, Jerry, W.; US
Mandataire :
PETERMAN, Brian, W.; 1101 S. Capital Of Texas Higway Building C, Suite 200 Austin, TX 78746, US
Données relatives à la priorité :
11/600,95716.11.2006US
Titre (EN) RECONFIGURABLE NEURAL NETWORK SYSTEMS AND METHODS UTILIZING FPGAS HAVING PACKET ROUTERS
(FR) SYSTÈMES ET PROCÉDÉS PERMETTANT DE FORMER DES RÉSEAUX NEURONAUX RECONFIGURABLES ET FAISANT APPEL À DES FPGA DOTÉS DE ROUTEURS DE PAQUETS
Abrégé :
(EN) Systems and methods are disclosed for forming reconfigurable neural networks with interconnected FPGAs each having a packet router. Neural network nodes are formed within the FPGAs and connections between nodes within an FPGA and connections to nodes external to the FGPA are made using packet routers that are configured within each FPGA. The FPGAs can be connected to each other using high-speed interconnects, such as high-speed serial digital interconnects. The FPGA arrays with packet routing allow for dynamic and reconfigurable neural networks to be formed thereby greatly improving the performance and intelligence of the neural network.
(FR) La présente invention concerne des systèmes et des procédés permettant de former des réseaux neuronaux reconfigurables dotés de FPGA interconnectés, dont chacun possède un routeur de paquets. Des noeuds de réseaux neuronaux sont formés à l'intérieur des FPGA et des connexions entre les noeuds d'un même FPGA et des connexions à des noeuds externes au FPGA sont établies à l'aide de routeurs de paquets qui sont configurés à l'intérieur de chaque FPGA. Les FPGA peuvent être reliés les uns aux autres à l'aide d'interconnexions à grande vitesse, telles que des interconnexions numériques en série à grande vitesse. Les réseaux de FPGA effectuant le routage de paquets permettent de former des réseaux neuronaux dynamiques et reconfigurables, ce qui améliore considérablement l'efficacité et l'intelligence du réseau neuronal.
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États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
Langue de publication : Anglais (EN)
Langue de dépôt : Anglais (EN)