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1. (WO2008059431) CIRCUIT INTÉGRÉ POUR CODER DES DONNÉES
Dernières données bibliographiques dont dispose le Bureau international

N° de publication : WO/2008/059431 N° de la demande internationale : PCT/IB2007/054588
Date de publication : 22.05.2008 Date de dépôt international : 12.11.2007
CIB :
H04L 1/00 (2006.01) ,H03M 13/03 (2006.01) ,H03K 19/173 (2006.01)
H ÉLECTRICITÉ
04
TECHNIQUE DE LA COMMUNICATION ÉLECTRIQUE
L
TRANSMISSION D'INFORMATION NUMÉRIQUE, p.ex. COMMUNICATION TÉLÉGRAPHIQUE
1
Dispositions pour détecter ou empêcher les erreurs dans l'information reçue
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
M
CODAGE, DÉCODAGE OU CONVERSION DE CODE, EN GÉNÉRAL
13
Codage, décodage ou conversion de code pour détecter ou corriger des erreurs; Hypothèses de base sur la théorie du codage; Limites de codage; Méthodes d'évaluation de la probabilité d'erreur; Modèles de canaux; Simulation ou vérification des codes
03
Détection d'erreurs ou correction d'erreurs transmises par redondance dans la représentation des données, c.à d. mots de code contenant plus de chiffres que les mots source
H ÉLECTRICITÉ
03
CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
K
TECHNIQUE DE L'IMPULSION
19
Circuits logiques, c. à d. ayant au moins deux entrées agissant sur une sortie; Circuits d'inversion
02
utilisant des éléments spécifiés
173
utilisant des circuits logiques élémentaires comme composants
Déposants :
NXP B.V. [NL/NL]; High Tech Campus 60 NL-5656 AG Eindhoven, NL (AllExceptUS)
GANDER, Martial [FR/FR]; GB (UsOnly)
ARDICHVILI, Emmanuel [FR/FR]; GB (UsOnly)
Inventeurs :
GANDER, Martial; GB
ARDICHVILI, Emmanuel; GB
Mandataire :
SCHUFFENECKER, Thierry; 120, Chemin de la Maure F-06800 Cagnes sur Mer, FR
Données relatives à la priorité :
06291775.214.11.2006EP
Titre (EN) INTEGRATED CIRCUIT TO ENCODE DATA
(FR) CIRCUIT INTÉGRÉ POUR CODER DES DONNÉES
Abrégé :
(EN) The Integrated circuit configurable to encode data according to any one of the coding schemes chosen in a predetermined plurality of coding schemes and to generate cyclic redundancy codes, comprises: a) a plurality of identical specific hardware cells, each cell comprising: • outputs SCij, FOCij, BOij and TOij for binary signals, • inputs Eij, BIij, FIij and TIij for binary signals, • a buffer to delay by one clock period a binary value received on input Eij and to output a one-clock period delayed binary value E*, • binary adders to perform XOR operations, • configurable multiplexers connecting the outputs, the inputs, the buffer and the adders to each other according to several configurable paths, b) controllable switch matrices external to each cell and able to electrically connect and, alternatively, to electrically disconnect inputs to/from outputs of another cell.
(FR) L'invention concerne des schémas de codage choisis dans une pluralité prédéterminée de l'un des schémas de codage et pour générer des codes de redondance cyclique comprenant : a) une pluralité de cellules matérielles spécifiques identiques, chaque cellule comprenant : des sorties SCij, FOCij, BOij et TOij pour des signaux binaires, des entrées Eij, BIij, FIij et TIij pour des signaux binaires, un tampon pour retarder d'une période d'horloge une valeur binaire reçue sur l'entrée Eij et pour émettre une valeur binaire retardée d'une période d'horloge E*, des sommateurs binaires pour réaliser des opérations XOR, des multiplexeurs configurables connectant les sorties, les entrées, le tampon et les sommateurs les uns aux autres conformément à plusieurs trajets configurables, b) des matrices de commutation commandables externes à chaque cellule et aptes à connecter électriquement et, en variante, à déconnecter électriquement les entrées aux/des sorties d'une autre cellule.
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États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
Langue de publication : Anglais (EN)
Langue de dépôt : Anglais (EN)
Également publié sous:
EP2092675US20100115378