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1. (WO2008042152) REQUANTIFICATION DANS UN PROCESSEUR DE DÉBIT BINAIRE DE RÉCEPTEUR DE LIAISON DESCENDANTE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/042152    N° de la demande internationale :    PCT/US2007/020637
Date de publication : 10.04.2008 Date de dépôt international : 25.09.2007
CIB :
H04B 1/707 (2006.01), H04L 1/00 (2006.01)
Déposants : MEDIATEK INC. [--/--]; No. 1, Dusing Road, 1st, Science-Based Industrial Park, Hsin-Chu 300 (TW) (Tous Sauf US).
MATHEW, Deepak [IN/US]; (US) (US Seulement).
YAN, Aiguo [US/US]; (US) (US Seulement).
VISHWANATHAN, Krishnan [IN/US]; (US) (US Seulement).
AARDOOM, Eric [NL/US]; (US) (US Seulement).
FISHER-JEFFES, Timothy [GB/GB]; (GB) (US Seulement)
Inventeurs : MATHEW, Deepak; (US).
YAN, Aiguo; (US).
VISHWANATHAN, Krishnan; (US).
AARDOOM, Eric; (US).
FISHER-JEFFES, Timothy; (GB)
Mandataire : MCCLELLAN, William R.; Wolf, Greenfield & Sacks, P.C., Federal Reserve Plaza, 600 Atlantic Avenue, Boston, MA 02210-2206 (US)
Données relatives à la priorité :
11/529,071 28.09.2006 US
Titre (EN) RE-QUANTIZATION IN DOWNLINK RECEIVER BIT RATE PROCESSOR
(FR) REQUANTIFICATION DANS UN PROCESSEUR DE DÉBIT BINAIRE DE RÉCEPTEUR DE LIAISON DESCENDANTE
Abrégé : front page image
(EN)A bit rate processor in a wireless system includes a front end processor to process physical channel data and to generate encoded transport channel data, a transport channel buffer to hold the encoded transport channel data, and a back end processor to process the encoded transport channel data from the transport channel buffer and to generate decoded transport channel bits. The front end processor may include a frame buffer that receives the physical channel data, a first stage to de-map the physical channel data from the frame buffer, an intermediate frame buffer that receives the de-mapped physical channel data from the first stage, and a second stage to process the de-mapped physical channel data and to provide the encoded transport channel data. The back end processor may include a third stage, including a scaling circuit to scale the encoded transport channel data, a decoder to decode the scaled transport channel data and a CRC checker to provide the decoded transport channel bits, and an output buffer to receive the decoded transport channel bits.
(FR)Selon l'invention, un processeur de débit binaire d'un système sans fil comprend un processeur frontal destiné à traiter des données de canal physique et à générer des données de canal physique codées, un tampon de canal de transport destiné à contenir les données de canal de transport codées, et un processeur dorsal destiné à traiter les données de canal de transport codées du tampon de canal de transport et à générer des bits de canal de transport décodés. Le processeur frontal peut comprendre un tampon de trames qui reçoit les données de canal physique, un premier étage destiné à démapper les données de canal physique du tampon de trames, un tampon de trames intermédiaire qui reçoit les données de canal physique démappées du premier étage, et un deuxième étage destiné à traiter les données de canal physique démappées et à fournir les données de canal de transport codées. Le processeur dorsal peut comprendre un troisième étage, comprenant un circuit d'échelle destiné à mettre à l'échelle les données de canal de transport codées, un décodeur destiné à décoder les données de canal de transport mises à l'échelle et un vérificateur de CRC destiné à fournir les bits de canal de transport décodés, ainsi qu'un tampon de sortie destiné à recevoir les bits de canal de transport décodés.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)