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1. (WO2008038235) PROCÉDÉ POUR GÉRER LA CHARGE D'ÉLÉMENTS PÉRIPHÉRIQUES DANS UN SYSTÈME MULTICŒUR
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2008/038235    N° de la demande internationale :    PCT/IB2007/053909
Date de publication : 03.04.2008 Date de dépôt international : 26.09.2007
CIB :
G06F 9/46 (2006.01)
Déposants : ECOLE POLYTECHNIQUE FEDERALE DE LAUSANNE (EPFL) [CH/CH]; CM-Ecublens, CH-1015 Lausanne (CH) (Tous Sauf US).
ANGIOLINI, Federico [IT/IT]; (IT) (US Seulement).
ATIENZA ALONSO, David [ES/CH]; (CH) (US Seulement).
DE MICHELI, Giovanni [IT/CH]; (CH) (US Seulement)
Inventeurs : ANGIOLINI, Federico; (IT).
ATIENZA ALONSO, David; (CH).
DE MICHELI, Giovanni; (CH)
Mandataire : LEMAN CONSULTING S.A. 284; Chemin de Précossy 31, CH-1260 Nyon (CH)
Données relatives à la priorité :
60/847,368 27.09.2006 US
Titre (EN) METHOD TO MANAGE THE LOAD OF PERIPHERAL ELEMENTS WITHIN A MULTICORE SYSTEM
(FR) PROCÉDÉ POUR GÉRER LA CHARGE D'ÉLÉMENTS PÉRIPHÉRIQUES DANS UN SYSTÈME MULTICŒUR
Abrégé : front page image
(EN)The aim of the present invention is to propose a method to provide reliability, power management and load balancing support for multicore systems based on Networks- on-Chip (NoCs) as well as a way to efficiently implement architectural support for this method by introducing complex packet handling mechanisms achieved by modifying the basic network interfaces attached to the cores of multicore computation systems. The present invention provides also a solution in interrupt-based support in NoCs for multicore computation systems against transient failures or other system-level issues while the system is executing a certain application. It also proposes policies to leverage the proposed hardware extensions. This aim is achieved thanks to a method to manage the load of peripheral elements within a multicore system, said multicore system comprising several processing cores accessing peripheral elements through a Network on Chip (NoC), each processing unit and peripheral element attached to a Network Interface in charge of formatting and driving the packets sent to or received from the Network on Chip, wherein, while considering at least two peripheral elements having a similar function, the Network Interface dedicated to a first peripheral element reroutes the incoming packets to a second Network Interface dedicated to a second peripheral element.
(FR)La présente invention concerne un procédé pour obtenir la fiabilité, la gestion de puissance et la prise en charge de l'équilibrage de charge pour des systèmes multicœurs basés sur des réseaux sur puces (NoC) ainsi qu'un moyen pour mettre en œuvre efficacement une prise en charge architecturale pour ce procédé en introduisant des mécanismes de gestion de paquets complexes obtenus en modifiant les interfaces de réseaux de base rattachées aux cœurs des systèmes de calcul multicœurs. La présente invention offre également une solution dans une prise en charge par interruption dans des NoC pour des systèmes de calcul multicœurs contre les pannes transitoires ou d'autres problèmes de niveau système pendant que le système exécute une certaine application. Elle concerne également des politiques pour mettre en œuvre les extensions matérielles proposées. Cet objectif est atteint grâce à un procédé pour gérer la charge des éléments périphériques dans un système multicœurs, ledit système multicœur comprenant plusieurs cœurs de traitement accédant à des éléments périphériques par un réseau sur puce (NoC), chaque unité de traitement et chaque élément périphérique étant rattachés à une interface de réseau en charge de formater et gérer les paquets envoyés au réseau sur puce ou reçus de celui-ci. Tout en considérant au moins deux éléments périphériques ayant une fonction similaire, l'interface de réseau dédiée à un premier élément périphérique route de nouveau les paquets entrants sur une seconde interface de réseau dédiée à un second élément périphérique.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BH, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DO, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, ME, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)