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1. WO2007149532 - SYSTÈME COMPILATEUR, PROCÉDÉ ET LOGICIEL POUR UNE ARCHITECTURE DE CIRCUIT INTÉGRÉ RÉSILIENT

Numéro de publication WO/2007/149532
Date de publication 27.12.2007
N° de la demande internationale PCT/US2007/014474
Date du dépôt international 20.06.2007
Demande présentée en vertu du Chapitre 2 18.01.2008
CIB
H03K 19/173 2006.01
HÉLECTRICITÉ
03CIRCUITS ÉLECTRONIQUES FONDAMENTAUX
KTECHNIQUE DE L'IMPULSION
19Circuits logiques, c. à d. ayant au moins deux entrées agissant sur une sortie; Circuits d'inversion
02utilisant des éléments spécifiés
173utilisant des circuits logiques élémentaires comme composants
CPC
G06F 15/17362
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
15Digital computers in general
16Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
163Interprocessor communication
173using an interconnection network, e.g. matrix, shuffle, pyramid, star, snowflake
17356Indirect interconnection networks
17362hierarchical topologies
G06F 15/7867
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
15Digital computers in general
76Architectures of general purpose stored program computers
78comprising a single central processing unit
7867with reconfigurable architecture
G06F 30/394
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
30Computer-aided design [CAD]
30Circuit design
39Circuit design at the physical level
394Routing
G06F 9/4881
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
46Multiprogramming arrangements
48Program initiating; Program switching, e.g. by interrupt
4806Task transfer initiation or dispatching
4843by program, e.g. task dispatcher, supervisor, operating system
4881Scheduling strategies for dispatcher, e.g. round robin, multi-level priority queues
G06F 9/5083
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
9Arrangements for program control, e.g. control units
06using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
46Multiprogramming arrangements
50Allocation of resources, e.g. of the central processing unit [CPU]
5083Techniques for rebalancing the load in a distributed system
H03K 19/003
HELECTRICITY
03BASIC ELECTRONIC CIRCUITRY
KPULSE TECHNIQUE
19Logic circuits, i.e. having at least two inputs acting on one output
003Modifications for increasing the reliability ; for protection
Déposants
  • ELEMENT CXI, LLC [US/US]; 1815 McCandless Drive Milpitas, CA 95035, US (AllExceptUS)
  • KELEM, Steven, Hennick [US/US]; US (UsOnly)
  • LANDAUER, Douglas, A. [US/US]; US (UsOnly)
Inventeurs
  • KELEM, Steven, Hennick; US
  • LANDAUER, Douglas, A.; US
Mandataires
  • GAMBURD, Nancy, R.; Gamburd Law Group LLC Suite 625 600 West Jackson Boulevard Chicago, IL 60661, US
Données relatives à la priorité
11/471,83221.06.2006US
11/471,87521.06.2006US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) COMPILER SYSTEM, METHOD AND SOFTWARE FOR A RESILIENT INTEGRATED CIRCUIT ARCHITECTURE
(FR) SYSTÈME COMPILATEUR, PROCÉDÉ ET LOGICIEL POUR UNE ARCHITECTURE DE CIRCUIT INTÉGRÉ RÉSILIENT
Abrégé
(EN)
The exemplary embodiments provide a compiler for a resilient integrated circuit. An exemplary IC comprises a plurality of composite circuit elements, a state machine element (SME), and a plurality of communication elements. Each composite circuit element comprises an element interface and a selected circuit element which may vary by element type, and which may be configurable. An exemplary compiler converts an algorithm into a plurality of tasks; assigns a task identifier to each task; determines an action, of a plurality of actions, corresponding to a first task of the plurality of tasks; assigns a first action identifier to a first action; maps the first action to a first type of composite computational element; determines a data input linkage or a data output linkage for the first action; and generates a compilation designating the first type of computational element and the data input linkage or the data output linkage for the first action. For fault tolerance and resilience, the compilation does not assign the first task and first action to a specific instance of the first type of computational element in the integrated circuit, which instead may be assigned during a run-time binding operation of the IC.
(FR)
L'invention concerne un compilateur pour un circuit intégré résilient. Un exemple de CI comprend une pluralité d'éléments de circuit composites, un élément (SME) machine d'état et une pluralité d'éléments de communication. Chaque élément de circuit composite comprend une interface d'élément et un élément de circuit sélectionné dont le type peut varier et qui peut être configurable. Un exemple de compilateur convertit un algorithme en une pluralité de tâches, affecte un identifiant de tâche à chaque tâche, détermine parmi une pluralité d'actions une action correspondant à une première tâche de la pluralité de tâches, affecte un premier identifiant d'action à une première action, met en correspondance la première action avec un premier type d'élément de calcul composite, détermine une liaison d'entrée de données ou une liaison de sortie de données pour la première action et génère une compilation désignant le premier type d'élément de calcul et la liaison d'entrée de données ou la liaison de sortie de données pour la première action. Pour la tolérance aux pannes et la résilience, la compilation n'affecte pas la première tâche et la première action à une instance spécifique du premier type d'élément de calcul dans le circuit intégré, celles-ci pouvant plutôt être affectées pendant une opération d'agrégation en exécution du circuit intégré.
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