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1. (WO2007102459) RECEPTEUR ET CIRCUIT D'ECHANTILLONNAGE DIRECT DE SIGNAUX TEMPORELS DISCRETS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/102459    N° de la demande internationale :    PCT/JP2007/054169
Date de publication : 13.09.2007 Date de dépôt international : 05.03.2007
CIB :
H03H 19/00 (2006.01), H04B 1/30 (2006.01)
Déposants : MATSUSHITA ELECTRIC INDUSTRIAL CO., LTD. [JP/JP]; 1006, Oaza Kadoma, Kadoma-shi, Osaka 5718501 (JP) (Tous Sauf US).
HOSOKAWA, Yoshifumi; (US Seulement).
ABE, Katsuaki; (US Seulement).
SAITO, Noriaki; (US Seulement).
ARAKI, Kiyomichi; (US Seulement).
MORISHITA, Yohei; (US Seulement)
Inventeurs : HOSOKAWA, Yoshifumi; .
ABE, Katsuaki; .
SAITO, Noriaki; .
ARAKI, Kiyomichi; .
MORISHITA, Yohei;
Mandataire : WASHIDA, Kimihito; 5th Floor, Shintoshicenter Bldg., 24-1 Tsurumaki 1-chome Tama-shi, Tokyo 2060034 (JP)
Données relatives à la priorité :
2006-061914 07.03.2006 JP
2006-150511 30.05.2006 JP
2007-025745 05.02.2007 JP
Titre (EN) DISCRETE TIME DIRECT SAMPLING CIRCUIT AND RECEIVER
(FR) RECEPTEUR ET CIRCUIT D'ECHANTILLONNAGE DIRECT DE SIGNAUX TEMPORELS DISCRETS
(JA) 離散時間ダイレクトサンプリング回路及び受信機
Abrégé : front page image
(EN)A direct sampling circuit and a receiver which carry out discrete time analog processing with a high degree of design freedom and are provided with a filter property which is achievable to comply with the receipt of a broad band signal. A plurality of discrete time analog processing circuits (101) are connected in parallel with each other, a gm value and a capacitance of a capacitor in each circuit system are set independently based on a prescribed condition, and an output signal obtained from each circuit system is synthesized by means of a buffer capacitor (102), so that an equivalently high-dimensional IIR filter can be put into practice.
(FR)La présente invention concerne un circuit d'échantillonnage direct et un récepteur qui réalisent un traitement analogique de signaux temporels discrets avec un degré élevé de liberté de conception et qui sont munis d'une propriété de filtre pouvant être conforme à la réception d'un signal large bande. Une pluralité de circuits de traitement analogique des signaux temporels discrets (101) sont connectés en parallèle les uns avec les autres, une valeur gm et une capacitance d'un condensateur dans chaque système de circuit sont réglés indépendamment, en fonction d'une condition prescrite, et un signal de sortie obtenu à partir de chaque systèmede circuit est synthétisé à l'aide d'un condensateur tampon (102), offrant ainsi la possibilité de mettre en pratique un filtre IIR de dimension aussi haute.
(JA) 広帯域信号の受信に対応可能なフィルタ特性を実現可能で、設計自由度が高い離散時間アナログ処理によるダイレクトサンプリング回路および受信機を提供する。複数の離散時間アナログ処理回路(101)を並列に接続し、各々の回路系統におけるgm値やキャパシタの容量値を、所定の条件に基づいて独立に設定し、各々の回路系統から得られる出力信号をバッファキャパシタ(102)によって合成することにより、等価的に高次なIIRフィルタ特性を実現する。
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, MT, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)