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1. (WO2007089545) PROCESSEUR DE TRAITEMENT D'ERREURS DE CALCUL
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/089545    N° de la demande internationale :    PCT/US2007/002089
Date de publication : 09.08.2007 Date de dépôt international : 23.01.2007
CIB :
G06F 11/00 (2006.01)
Déposants : SEARETE LLC [US/US]; 1756-114th Ave. SE, Suite 110, Bellevue, Washington 98004 (US) (Tous Sauf US).
FERREN, Bran [US/US]; (US) (US Seulement).
HILLIS, W. Daniel [US/US]; (US) (US Seulement).
MANGIONE-SMITH, William Henry [US/US]; (US) (US Seulement).
MYHRVOLD, Nathan P. [US/US]; (US) (US Seulement).
TEGREENE, Clarence T. [US/US]; (US) (US Seulement).
WOOD, Lowell L. Jr. [US/US]; (US) (US Seulement)
Inventeurs : FERREN, Bran; (US).
HILLIS, W. Daniel; (US).
MANGIONE-SMITH, William Henry; (US).
MYHRVOLD, Nathan P.; (US).
TEGREENE, Clarence T.; (US).
WOOD, Lowell L. Jr.; (US)
Mandataire : COOK, Dale R.; 1756-114th Avenue SE, #110, Bellevue, Washington 98004 (US)
Données relatives à la priorité :
11/343,745 31.01.2006 US
11/343,927 31.01.2006 US
11/364,131 28.02.2006 US
11/364,573 28.02.2006 US
11/364,130 28.02.2006 US
Titre (EN) HANDLING PROCESSOR COMPUTATIONAL ERRORS
(FR) PROCESSEUR DE TRAITEMENT D'ERREURS DE CALCUL
Abrégé : front page image
(EN)Embodiments include a computer processor-error controller, a computerized device, a device, an apparatus, and a method. A computer processor-error controller includes a monitoring circuit operable to detect a computational error corresponding to an execution of a second instruction by a processor operable to execute a sequence of program instructions that includes a first instruction that is fetched before the second instruction. The computer processor-error controller includes an error recovery circuit operable to restore an execution of the sequence of program instructions to the first instruction in response to the detected computational error.
(FR)L'invention concerne, dans des modes de réalisation, un contrôleur d'erreurs de processeur informatique, un dispositif informatisé, un dispositif, un appareil, et un procédé. Le contrôleur d'erreurs de processeur informatique comporte un circuit de surveillance destiné à détecter une erreur de calcul correspondant à une exécution d'une seconde instruction par un processeur destiné à exécuter une séquence d'instructions de programme comportant une première instruction qui est recherchée avant la seconde instruction. Le contrôleur d'erreurs de processeur informatique comporte un circuit de récupération d'erreurs destiné à rétablir une exécution de la séquence d'instructions de programme à la première instruction en réponse à l'erreur de calcul détectée.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)