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1. (WO2007088986) CIRCUIT DE COMMANDE ET DISPOSITIF D'AFFICHAGE COMPRENANT CELUI-CI
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/088986    N° de la demande internationale :    PCT/JP2007/051836
Date de publication : 09.08.2007 Date de dépôt international : 29.01.2007
CIB :
G09G 3/36 (2006.01), G09G 3/20 (2006.01)
Déposants : SHARP KABUSHIKI KAISHA [JP/JP]; 22-22, Nagaike-cho, Abeno-ku, Osaka-shi, Osaka, 5458522 (JP) (Tous Sauf US).
JOHN, Gareth; (US Seulement).
ZEBEDEE, Patrick; (US Seulement).
BROWNLOW, Michael; (US Seulement).
GASSER, Tim; (US Seulement).
LOCK, Jeremy; (US Seulement).
CAIRNS, Graham; (US Seulement).
RAJENDRA, Jaganath; (US Seulement).
WALTON, Harry; (US Seulement)
Inventeurs : JOHN, Gareth; .
ZEBEDEE, Patrick; .
BROWNLOW, Michael; .
GASSER, Tim; .
LOCK, Jeremy; .
CAIRNS, Graham; .
RAJENDRA, Jaganath; .
WALTON, Harry;
Mandataire : HARAKENZO WORLD PATENT & TRADEMARK; Daiwa Minamimorimachi Building, 2-6, Tenjinbashi 2-chome Kita,, Kita-ku, Osaka-shi, Osaka 5300041 (JP)
Données relatives à la priorité :
0601894.9 31.01.2006 GB
Titre (EN) A DRIVE CIRCUIT, A DISPLAY DEVICE PROVIDED WITH THE SAME
(FR) CIRCUIT DE COMMANDE ET DISPOSITIF D'AFFICHAGE COMPRENANT CELUI-CI
Abrégé : front page image
(EN)A drive circuit (10) comprises: a logic block (3) connected between a source of a first voltage (VDD) and a source of a second voltage (VSS), and a sampler (5) having a plurality of sampling circuits. Each sampling circuit is for sampling, in use, an input data signal and outputting a voltage to a respective output (O). The drive circuit further comprises a voltage booster (11) having plurality of voltage boost circuits, each voltage boost circuit being associated with a respective one of the sampling circuits and, in use, generating a boosted voltage signal and providing the boosted voltage signal to the respective sampling circuit. Each voltage boost circuit is connected between the source of the first voltage (VDD) and the source of the second voltage (VSS). The logic block (3) may be, but is not limited to, a shift register.
(FR)L'invention concerne un circuit de commande (10) comprenant: un bloc logique (3) connecté entre une source d'une première tension (VDD) et une source d'une seconde tension (VSS), et un échantillonneur (5) comportant une pluralité de circuits échantillonneurs. Chaque circuit échantillonneur sert, en service, à l'échantillonnage d'un signal de données d'entrée et à la production d'une tension au niveau d'une sortie (O) respective. Le circuit de commande comprend également un survolteur (11) comportant une pluralité de circuits survolteurs, chaque circuit survolteur étant associé à un circuit échantillonneur respectif et produisant, en service, un signal de survoltage qui est fourni au circuit échantillonneur respectif. Chaque circuit survolteur est connecté entre la source de la première tension (VDD) et la source de la seconde tension (VSS). Le bloc logique (3) peut être, sans exclure d'autres application, un registre à décalage.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)