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1. (WO2007088581) PROCÉDÉ D'APPEL DE PROCÉDURE DANS UN MULTIPROCESSEUR À MÉMOIRE PARTAGÉE, PROGRAMME D'APPEL DE PROCÉDURE ET SUPPORT D'ENREGISTREMENT
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/088581    N° de la demande internationale :    PCT/JP2006/301532
Date de publication : 09.08.2007 Date de dépôt international : 31.01.2006
CIB :
G06F 15/167 (2006.01), G06F 15/17 (2006.01), G06F 9/54 (2006.01)
Déposants : FUJITSU LIMITED [JP/JP]; 1-1, Kamikodanaka 4-chome, Nakahara-ku, Kawasaki-shi, Kanagawa 2118588 (JP) (Tous Sauf US).
SUZUKI, Takahisa [JP/JP]; (JP) (US Seulement).
MIYAKE, Hideo [JP/JP]; (JP) (US Seulement)
Inventeurs : SUZUKI, Takahisa; (JP).
MIYAKE, Hideo; (JP)
Mandataire : SAKAI, Akinori; A. SAKAI & ASSOCIATES 20F, Kasumigaseki Building 2-5, Kasumigaseki 3-chome Chiyoda-ku, Tokyo 1006020 (JP)
Données relatives à la priorité :
Titre (EN) PROCEDURE CALLING METHOD IN SHARED MEMORY MULTIPROCESSOR, PROCEDURE CALLING PROGRAM AND RECORDING MEDIUM
(FR) PROCÉDÉ D'APPEL DE PROCÉDURE DANS UN MULTIPROCESSEUR À MÉMOIRE PARTAGÉE, PROGRAMME D'APPEL DE PROCÉDURE ET SUPPORT D'ENREGISTREMENT
(JA) 共有メモリ型マルチプロセッサにおける手続き呼び出し方法、手続き呼び出しプログラムおよび記録媒体
Abrégé : front page image
(EN)In a shared memory multiprocessor arranged such that a plurality of processors (22, 23) share an identical memory (24), and each processor (22, 23) has an independent address space (25, 26) in the shared memory (24) and can communicate with each other through inter-processor communication (27) utilizing a bus, the first processor (22) specifies an address existing in the address space (26) of the second processor (23) and performs calling of procedure for the second processor (23). In response to that calling of procedure, the second processor (23) actuates and executes a procedure at the address specified by the first processor (22) thus actuating the procedure at a high speed.
(FR)Dans un multiprocesseur à mémoire partagée conçu de façon qu'une pluralité de processeurs (22, 23) partagent une mémoire identique (24), et que ces processeurs (22, 23) possèdent chacun un espace adresse indépendant (25, 26) dans la mémoire partagée (24) et puissent communiquer l'un avec l'autre par l'intermédiaire d'une communication inter-processeur (27) faisant appel à un bus, le premier processeur (22) spécifie une adresse existant dans l'espace adresse (26) du second processeur (23) et effectue un appel de procédure pour le second processeur (23). En réponse à cet appel de procédure, le second processeur (23) met en oeuvre et exécute une procédure au niveau de l'adresse spécifiée par le premier processeur (22), d'où la mise en oeuvre de la procédure à une vitesse élevée.
(JA) 複数のプロセッサ(22,23)が同一の共有メモリ(24)を共有し、かつその共有メモリ(24)に各プロセッサ(22,23)がそれぞれ独立したアドレス空間(25,26)を有し、さらに各プロセッサ(22,23)が互いにバスを利用したプロセッサ間通信(27)を介して通信可能に構成された共有メモリ型マルチプロセッサにおいて、第1のプロセッサ(22)が、第2のプロセッサ(23)のアドレス空間(26)に存在するアドレスを指定して、第2のプロセッサ(23)に対して手続の呼び出しを行う。その手続の呼び出しに応答して、第2のプロセッサ(23)は、第1のプロセッサ(22)により指定されたアドレスにある手続を起動して実行することにより、高速に手続を起動する。
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)