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1. (WO2007085532) INTERFACE DE BUS DE DONNÉES AVEC HORLOGE INTERRUPTIBLE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/085532    N° de la demande internationale :    PCT/EP2007/050261
Date de publication : 02.08.2007 Date de dépôt international : 11.01.2007
CIB :
G06F 13/42 (2006.01), G06F 1/32 (2006.01), H04L 25/06 (2006.01)
Déposants : THOMSON LICENSING [FR/FR]; 46 Quai A. Le Gallo, 92100 Boulogne-Billancourt (FR) (Tous Sauf US).
HEIZMANN, Friedrich [DE/DE]; (DE) (US Seulement)
Inventeurs : HEIZMANN, Friedrich; (DE)
Mandataire : LINDEMANN, Robert; Deutsche Thomson OHG, European Patent Operations, Karl-Wiechert-Allee 74, 30625 Hannover (DE)
Données relatives à la priorité :
10 2006 004 346.4 30.01.2006 DE
Titre (EN) DATA BUS INTERFACE WITH INTERRUPTIBLE CLOCK
(FR) INTERFACE DE BUS DE DONNÉES AVEC HORLOGE INTERRUPTIBLE
Abrégé : front page image
(EN)In a data bus with asynchronous data transmission via a clock and a data line, the transmitted data are ascertained by sampling with a multiple of the data rate of the data bus. Sampling is done in this case with a clock which is not synchronous with the asynchronous clock of the data bus. For avoiding interferences which develop due to the unnecessary operation of the interface circuit with a high frequency clock when no data are currently transmitted, a control circuit is provided for detecting the beginning and the end of a data transmission. Only at the beginning of a data transmission, the interface circuit will be supplied with the required clock. After the end of the data transmission, the clock for the interface circuit will be switched off again. The control circuit is preferably designed as a state machine which reacts, without the need for clock signals, to the states on the data and clock line of the data bus.
(FR)Selon l'invention, dans un bus de données avec une transmission de données asynchrone par l'intermédiaire d'une horloge et d'une ligne de données, les données transmises sont vérifiées par échantillonnage avec un multiple du débit de données du bus de données. L'échantillonnage est effectué dans ce cas avec une horloge qui n'est pas synchrone avec l'horloge asynchrone du bus de données. Pour éviter que des interférences ne se développent en raison du fonctionnement inutile du circuit d'interface avec une horloge haute fréquence lorsqu'aucune donnée n’est actuellement transmise, un circuit de commande est disposé pour détecter le début et la fin d'une transmission de données. Le circuit d'interface ne sera alimenté avec l'horloge demandée au début d'une transmission de données. Après la fin de la transmission de données, l'horloge pour le circuit d'interface sera arrêtée de nouveau. Le circuit de commande est de préférence conçu comme une machine d'états qui réagit, sans nécessiter de signaux d'horloge, aux états sur la ligne de données et d'horloge du bus de données.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)