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1. (WO2007055444) CONTROLEUR PCI CIBLE VERSATILE PAR CONCEPTION
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/055444    N° de la demande internationale :    PCT/KR2006/000610
Date de publication : 18.05.2007 Date de dépôt international : 22.02.2006
CIB :
G06F 13/40 (2006.01)
Déposants : DAEGU GYEONGBUK INSTITUTE OF SCIENCE AND TECHNOLOGY [KR/KR]; 26f, Samsung Finance B/D, 110, Ducksan-dong, Jung-gu, Daegu 700-070 (KR) (Tous Sauf US).
LEE, Jong Hun [KR/KR]; (KR) (US Seulement).
JUNG, Woo Young [KR/KR]; (KR) (US Seulement).
HYUN, You Jin [KR/KR]; (KR) (US Seulement)
Inventeurs : LEE, Jong Hun; (KR).
JUNG, Woo Young; (KR).
HYUN, You Jin; (KR)
Mandataire : CHOI, Kyeong Su; 2Fl, 333-7, Namsan-dong, Jung-gu, Daegu 700-440 (KR)
Données relatives à la priorité :
10-2005-0108234 11.11.2005 KR
Titre (EN) A TARGET CONTROLLER OF PERIPHERAL COMPONENT INTERCONNECTION HAVING VERSATILITIES IN DESIGN
(FR) CONTROLEUR PCI CIBLE VERSATILE PAR CONCEPTION
Abrégé : front page image
(EN)A Peripheral Component Interconnection (PCI) target controller apparatus based on a PCI 2.x protocol (i.e., a PCI 2.1 protocol, a PCI 2.2 protocol, and a PCI 2.3 protocol) is disclosed. If a bus master requests a memory write command from a target device, the target device answers the memory write command, receives data from the bus master, and records the received data in a local device, or if the bus master requests a memory read command from the target device, the target device answers the memory read command, and reads data from the local device via a local bus. The target controller does not additionally include a pre-fetched memory or a internal FIFO (First In First Out) unit therein, but arranges the pre-fetched memory or the FIFO unit at an external part, such that a memory size can be selectively determined according to a request from an application board to be designed.
(FR)La présente invention concerne un contrôleur PCI cible (Peripheral Component Interconnection) utilisant les protocoles PCI 2.1 à 2.3. En l'occurrence, lorsqu'un maître de bus demande à un terminal cible une écriture en mémoire, ce dernier répond par la commande d'écriture en mémoire, reçoit des données du maître de bus, et enregistre les données reçues dans un terminal local. Lorsqu'au contraire un maître de bus demande à un terminal cible une lecture en mémoire, ce dernier répond par la commande de lecture en mémoire et fait la lecture des données depuis le terminal local via le bus local. Le contrôleur cible ne comporte pas, en plus, de mémoire de prélecture ou de pile FIFO, mais les organise au niveau d'une unité externe, si bien que la taille mémoire se définit de façon sélective en fonction d'une demande provenant d'une carte d'application à concevoir.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : coréen (KO)