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1. (WO2007054871) DISPOSITIF DE COMMANDE AVEC REGISTRES D'INDICATEURS POUR LA SYNCHRONISATION DE COMMUNICATIONS ENTRE DES CŒURS
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/054871    N° de la demande internationale :    PCT/IB2006/054104
Date de publication : 18.05.2007 Date de dépôt international : 03.11.2006
CIB :
G06F 15/167 (2006.01)
Déposants : NXP B.V. [NL/NL]; High Tech Campus 60, NL-5656 AG Eindhoven (NL) (Tous Sauf US).
CHANCEL, Francois [FR/FR]; (NL) (US Seulement).
FULCHERI, Patrick [FR/FR]; (NL) (US Seulement)
Inventeurs : CHANCEL, Francois; (NL).
FULCHERI, Patrick; (NL)
Mandataire : PENNINGS, Johannes, F., M.; C/o Professor Holstlaan 6, NL-5656 AA Eindhoven (NL)
Données relatives à la priorité :
05300900.7 08.11.2005 EP
Titre (EN) CONTROL DEVICE WITH FLAG REGISTERS FOR SYNCHRONIZATION OF COMMUNICATIONS BETWEEN CORES
(FR) DISPOSITIF DE COMMANDE AVEC REGISTRES D'INDICATEURS POUR LA SYNCHRONISATION DE COMMUNICATIONS ENTRE DES CŒURS
Abrégé : front page image
(EN)A control device (D) is a part of an integrated circuit (IC) comprising at least two cores (C1,C2) coupled, via buses (BCl, BC2), to a memory (M) arranged to store data to be transferred between these cores (Cl, C2). This control device (D) comprises at least one flag register (FRl, FR2) coupled to the cores (C1,C2) via the buses (BCl, BC2) and arranged to store, at Ni addresses, Ni flag values associated to data stored into the memory (M) by one of the cores and ready to be transferred towards the other core, each flag value stored at a first address being able to be set or reset by one of the cores (C1,C2) by means of a command designating the first address, thus authorizing another flag value stored at a second address to be simultaneously set or reset by the other core (C2,C1) by means of a command designating the second address.
(FR)L'invention concerne un dispositif de commande (D) qui fait partie d'un circuit intégré (IC) comprenant au moins deux cœurs (C1, C2) reliés, par l'intermédiaire de bus (BC1, BC2), à une mémoire (M) agencée pour mémoriser des données à transférer entre ces cœurs (C1, C2). Ce dispositif de commande (D) comprend au moins un registre d'indicateur (FR1, FR2) relié au cœurs (C1, C2) par l'intermédiaire des bus (BC1, BC2) et agencé pour mémoriser, à Ni adresses, Ni valeurs d'indicateurs associées aux données mémorisées dans la mémoire (M) par l'un des cœurs et prêtes à être transférées vers l'autre cœur, chaque valeur d'indicateur, mémorisée à une première adresse, pouvant être mise à 1 ou à 0 par l'un des cœurs (C1, C2) au moyen d'une instruction désignant la première adresse, ce qui autorise ainsi une autre valeur d'indicateur, mémorisée à une seconde adresse, d'être simultanément mise à 1 ou à 0 par l'autre cœur (C2, C1) au moyen d'une instruction désignant le seconde adresse.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, GT, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MY, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SV, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)