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1. (WO2007017444) SYSTEME DE MICROPROCESSEUR POUR COMMANDER OU REGLER DES PROCESSUS RELEVANT AU MOINS EN PARTIE DE LA SECURITE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2007/017444    N° de la demande internationale :    PCT/EP2006/064976
Date de publication : 15.02.2007 Date de dépôt international : 02.08.2006
CIB :
G06F 11/10 (2006.01), G06F 11/16 (2006.01)
Déposants : CONTINENTAL TEVES AG & CO. OHG [DE/DE]; Guerickestrasse 7, 60488 Frankfurt (DE) (Tous Sauf US).
FEY, Wolfgang [DE/DE]; (DE) (US Seulement).
KIRSCHBAUM, Andreas [DE/DE]; (DE) (US Seulement).
TRASKOV, Adrian [DE/DE]; (DE) (US Seulement)
Inventeurs : FEY, Wolfgang; (DE).
KIRSCHBAUM, Andreas; (DE).
TRASKOV, Adrian; (DE)
Représentant
commun :
CONTINENTAL TEVES AG & CO. OHG; Guerickestrasse 7, 60488 Frankfurt (DE)
Données relatives à la priorité :
10 2005 038 306.8 11.08.2005 DE
10 2006 036 384.1 02.08.2006 DE
Titre (DE) MIKROPROZESSORSYSTEM ZUR STEUERUNG BZW. REGELUNG VON ZUMINDEST ZUM TEIL SICHERHEITSKRITISCHEN PROZESSEN
(EN) MICROPROCESSOR SYSTEM FOR CONTROLLING OR REGULATING AT LEAST PARTIALLY SAFETY-CRITICAL PROCESSES
(FR) SYSTEME DE MICROPROCESSEUR POUR COMMANDER OU REGLER DES PROCESSUS RELEVANT AU MOINS EN PARTIE DE LA SECURITE
Abrégé : front page image
(DE)Mikroprozessorsystem (50) zur Steuerung bzw. Regelung von zumindest zum Teil sicherheitskritischen Prozessen umfassend zwei in einem Chipgehäuse integrierte Zentralrecheneinheiten (1,2), ein erstes und ein zweites Bussystem, zumindest einen vollständiger Speicher (7) am ersten Bussystem, mindestens einen Prüf datenspeicher (51) am zweiten Bussystem, welcher gegenüber dem vollständige Speicher am ersten Bussystem einen reduzierten Speicherumfang hat und in dem Prüfdaten gespeichert sind, die mit Daten des Speichers (7) am ersten Bussystem zusammenhängen, wobei die Bussysteme Vergleichs- und/oder Treiberkomponenten umfassen, welche den Datenaustausch und/oder Vergleich von Daten zwischen den beiden Bussystemen ermöglichen und wobei zumindest am zweiten Bussystem ein Hardware-Prüf datengenerator (4) angeordnet ist, wobei zumindest ein Teil des vollständigen Speichers am ersten Bus mittels eines weiteren Prüfdatenspeichers (5) und Prüfdaten am ersten Bus zusätzlich abgesichert ist. Die Erfindung betrifft außerdem die Verwendung des obigen Mikroprozessorsystems in Kraftfahrzeugsteuergeräten.
(EN)Disclosed is a microprocessor system (50) for controlling or regulating at least partially safety-critical processes. Said microprocessor system (50) comprises two central arithmetic units (1, 2) that are integrated into a chip housing, a first and a second bus system, at least one complete memory (7) on the first bus system, at least one test data memory (51) on the second bus system, which has a reduced storage capacity compared to the complete memory on the first bus system and in which test data is stored that correlate with data of the memory (7) on the first bus system. The bus systems are provided with comparative components and/or driver components that allow data to be exchanged and/or compared between the two bus systems. A hardware test data generator (4) is disposed at least on the second bus system. At least some of the complete memory on the first bus is additionally secured by means of another test data memory (5) and test data on the second bus. The invention further relates to the use of said microprocessor system in control devices of motor vehicles.
(FR)La présente invention concerne un système de microprocesseur (50) pour commander ou régler des processus relevant au moins en partie de la sécurité, comprenant: deux unités centrales de calcul (1,2) intégrées à un boîtier de puce; un premier et un second système de bus; au moins une mémoire intégrale (7) au niveau du premier système de bus; au moins une mémoire de données de vérification (51) au niveau du second système de bus, qui a des dimensions réduites par rapport à celles de la mémoire intégrale au niveau du premier système de bus, et dans laquelle sont enregistrées de données de vérification qui sont en relation avec des données de la mémoire (7) au niveau du premier système de bus, les systèmes de bus comprenant des composantes de comparaison et/ou de transfert qui permettent l'échange et/ou la comparaison de données entre les deux systèmes de bus, et un générateur de données de vérification de matériel (4) se trouvant au moins au niveau du second système de bus, au moins une partie de la mémoire intégrale au niveau du premier bus, étant en outre sécurisée au moyen d'une autre mémoire de données de vérification (5) et de données de vérification au niveau du premier bus. L'invention a également pour objet l'utilisation du système de microprocesseur décrit ci-dessus, dans des dispositifs de commande de véhicules automobiles.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HN, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LA, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RS, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : allemand (DE)
Langue de dépôt : allemand (DE)