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1. (WO2006127613) SYSTEME INFORMATIQUE MULTIPROCESSEUR SYMETRIQUE INSENSIBLE AUX DEFAILLANCES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2006/127613    N° de la demande internationale :    PCT/US2006/019754
Date de publication : 30.11.2006 Date de dépôt international : 23.05.2006
CIB :
G06F 12/10 (2006.01), G06F 13/28 (2006.01)
Déposants : MARATHON TECHNOLOGIES CORPORATION [US/US]; 295 Foster Street, Littleton, Massachusetts 01464-2004 (US) (Tous Sauf US).
LEVEILLE, Paul, A. [US/US]; (US) (US Seulement).
BISSETT, Thomas, D. [US/US]; (US) (US Seulement).
CORBIN, Stephen, S. [US/US]; (US) (US Seulement).
MELNICK, Jerry [US/US]; (US) (US Seulement).
TREMBLAY, Glenn, A. [US/US]; (US) (US Seulement).
WATANABE, Satoshi [JP/JP]; (JP) (US Seulement).
KOYAMA, Keiichi [JP/JP]; (JP) (US Seulement)
Inventeurs : LEVEILLE, Paul, A.; (US).
BISSETT, Thomas, D.; (US).
CORBIN, Stephen, S.; (US).
MELNICK, Jerry; (US).
TREMBLAY, Glenn, A.; (US).
WATANABE, Satoshi; (JP).
KOYAMA, Keiichi; (JP)
Mandataire : HAYDEN, John, F.; FISH & RICHARDSON P.C., P.O. Box 1022, Minneapolis, Minnesota 55440-1022 (US)
Données relatives à la priorité :
60/683,801 24.05.2005 US
Titre (EN) SYMMETRIC MULTIPROCESSOR FAULT TOLERANT COMPUTER SYSTEM
(FR) SYSTEME INFORMATIQUE MULTIPROCESSEUR SYMETRIQUE INSENSIBLE AUX DEFAILLANCES
Abrégé : front page image
(EN)A symmetric multiprocessing fault-tolerant computer system [100] controls memory access in a symmetric multiprocessing computer system. To do so, virtual page structures are created, where the virtual page structures reflect physical page access privileges to shared memory for processors in a symmetric multiprocessing computer system. Access to shared memory is controlled based on physical page access privileges reflected in the virtual paging structures to coordinate deterministic shared memory access between processors in the symmetric multiprocessing computer system. A symmetric multiprocessing fault-tolerant computer system may use duplication or continuous replay.
(FR)Cette invention concerne un système informatique multiprocesseur symétrique insensible aux défaillances, lequel système contrôle l'accès mémoire dans un système multiprocesseur symétrique. Pour ce faire, des structures de pages virtuelles sont créées; elles contiennent des privilèges d'accès par pages physiques à une mémoire partagée pour des processeurs dans un système informatique multiprocesseur symétrique. L'accès à la mémoire partagée est commandée sur la base de privilèges d'accès par pages physiques contenus dans les structures de pages virtuelles afin de coordonner l'accès à la mémoire partagée entre les processeurs dans ledit système informatique. Un système informatique multiprocesseur symétrique insensible aux défaillances peut utiliser la reproduction ou la réexécution en continu.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)