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1. (WO2006125157) GENERATION D'EFFACEMENT DANS UN SYSTEME DE COMMUNICATION A CORRECTION D'ERREUR SANS VOIE DE RETOUR
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2006/125157    N° de la demande internationale :    PCT/US2006/019456
Date de publication : 23.11.2006 Date de dépôt international : 18.05.2006
CIB :
H03M 13/15 (2006.01), H03M 13/09 (2006.01), H04L 1/00 (2006.01)
Déposants : TELEGENT SYSTEMS, INC. [GB/US]; 555 North Mathilda Avenue, Suite 110, Sunnyvale, CA 94085 (US) (Tous Sauf US).
GUO, Sharori [CN/US]; (US) (US Seulement)
Inventeurs : GUO, Sharori; (US)
Mandataire : SHEMWELL, Charles, E.; Shemwell Mahamedi, 4880 Stevens Creek Blvd., Suite 201, San Jose, CA 95129 (US)
Données relatives à la priorité :
60/682,196 18.05.2005 US
Titre (EN) ERASURE GENERATION IN A FORWARD-ERROR-CORRECTING COMMUNICATION SYSTEM
(FR) GENERATION D'EFFACEMENT DANS UN SYSTEME DE COMMUNICATION A CORRECTION D'ERREUR SANS VOIE DE RETOUR
Abrégé : front page image
(EN)A first data packet is received within an integrated circuit device and stored within a first memory thereof starting at a first address that is determined by the size of one or more previously received data packets. An error descriptor value is updated within a second memory of the integrated circuit device, the error descriptor including an error field that indicates an error that is associated with the first data packet, an address field that indicates the first address within the first memory and a length field that indicates a range of storage locations to which the error applies. A multiple-bit error value is generated based, at least in part, on the error descriptor, each bit of the multiple-bit error value corresponding to a respective storage location within a storage row of the first memory. The state of one or more bits within the storage row of the first memory are changed based, at least in part, on the multiple-bit error value.
(FR)L'invention concerne un premier paquet de données reçu dans un dispositif à circuit intégré est stocké dans une première mémoire de celui-ci qui débute à une première adresse déterminée par la dimension d'un ou plusieurs paquets de données reçus préalablement. Une valeur descriptrice d'erreur est mise à jour dans une seconde mémoire du dispositif à circuit intégré, le descripteur d'erreur comprend un champ d'erreur qui indique une erreur associée au premier paquet de données, un champ d'adresse qui indique la première adresse dans la première mémoire et un champ de longueur qui indique une gamme d'emplacement de stockage auquel l'erreur s'applique. Une valeur d'erreur à bits multiples est générée sur la base, au moins en partie, du descripteur d'erreur, chaque bit de la valeur d'erreur à bits multiples correspondant à un emplacement de stockage respectif dans une rangée de stockage de la première mémoire. L'état d'un ou plusieurs bits dans la rangée de stockage de la première mémoire est modifié sur la base, au moins en partie, de la valeur d'erreur à bits multiples.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)