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1. (WO2006051692) SYSTÈME DE MÉMOIRE NON VOLATILE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2006/051692    N° de la demande internationale :    PCT/JP2005/019766
Date de publication : 18.05.2006 Date de dépôt international : 27.10.2005
CIB :
G06F 12/14 (2006.01), G06F 12/16 (2006.01), G06K 19/07 (2006.01)
Déposants : SHARP KABUSHIKI KAISHA [JP/JP]; 22-22, Nagaike-cho, Abeno-ku Osaka-shi, Osaka 5458522 (JP) (Tous Sauf US).
OGAWA, Ryuichi [JP/JP]; (JP) (US Seulement)
Inventeurs : OGAWA, Ryuichi; (JP)
Mandataire : MASAKI, Yoshifumi; Yodoyabashi NAO Bldg. 7F 3-6, Imabashi 4-chome Chuo-ku, Osaka-shi Osaka 5410042 (JP)
Données relatives à la priorité :
2004-325953 10.11.2004 JP
Titre (EN) NONVOLATILE MEMORY SYSTEM
(FR) SYSTÈME DE MÉMOIRE NON VOLATILE
(JA) 不揮発性メモリシステム
Abrégé : front page image
(EN)A technique for preventing an erroneous write in and an erroneous erase from a nonvolatile memory, in the case of an erroneous operation of an arithmetic processor, at a low cost without providing any external circuit. A nonvolatile memory system comprises a nonvolatile memory, a volatile memory for storing a program containing an operation instruction to rewrite the contents of the nonvolatile memory, a processing device for controlling the nonvolatile memory and the volatile memory, first invalid instruction writing means for writing an invalid instruction in place of the operation instruction, at an initialization, at a predetermined address of the volatile memory for storing the operation instruction to the nonvolatile memory, control means for writing the operation instruction at the predetermined address of the volatile memory stored with the invalid instruction, before the start of the operation of the nonvolatile memory, and for operating the nonvolatile memory on the basis of the operation instruction, and second invalid instruction writing means for writing the invalid instruction at the predetermined address of the volatile memory after the execution of the operation of the nonvolatile memory.
(FR)L'invention concerne une technique pour empêcher une écriture erronée et un effacement erroné d’une mémoire non volatile dans le cas d’un fonctionnement erroné d’un processeur arithmétique, à faible coût et sans nécessiter de circuit externe. Le système de mémoire non volatile comprend une mémoire non volatile, une mémoire volatile pour stocker un programme contenant une instruction d’opération de réécriture du contenu de la mémoire non volatile, un dispositif de traitement pour contrôler la mémoire non volatile et la mémoire volatile, un premier moyen d’écriture d’instruction invalide pour écrire une instruction invalide à la place de l’instruction d’opération, lors d’une initialisation, à une adresse prédéterminée de la mémoire volatile pour stocker l’instruction d’instruction dans la mémoire non volatile, un moyen de contrôle pour écrire l’instruction d’opération à l’adresse prédéterminée de la mémoire volatile contenant l’instruction invalide, avant le début de l’opération de la mémoire non volatile, et pour faire fonctionner la mémoire non volatile sur la base de l’instruction d’opération, et un deuxième moyen d’écriture d’instruction invalide pour écrire l’instruction invalide à l’adresse prédéterminée de la mémoire volatile après exécution de l’opération de la mémoire non volatile.
(JA) 本発明は、演算処理装置が誤動作した場合等に、外付け回路を設けることなく低コストで、不揮発性メモリへの誤書き込み及び誤消去を防止する技術を提供する。本発明の不揮発性メモリシステムは、不揮発性メモリと、不揮発性メモリの内容を書き換える操作命令を含むプログラムを格納する揮発性メモリと、不揮発性メモリ及び揮発性メモリを制御する演算処理装置と、初期化の際に、不揮発性メモリに対する操作命令を格納するための揮発性メモリの所定のアドレスに、操作命令に代えて無効命令を書き込む第1無効命令書込手段と、不揮発性メモリの操作開始前に、無効命令を格納した揮発性メモリの所定のアドレスに操作命令を書き込み、操作命令に基づいて不揮発性メモリを操作する制御手段と、不揮発性メモリの操作実行後に、揮発性メモリの所定のアドレスに、無効命令を書き込む第2無効命令書込手段と、を備える。  
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KN, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)