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1. (WO2006045924) PROTECTION CONTRE LES ATTAQUES PAR GENERATION DE FAUTES SUR LES INSTRUCTIONS DE SAUT
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2006/045924    N° de la demande internationale :    PCT/FR2005/002582
Date de publication : 04.05.2006 Date de dépôt international : 18.10.2005
CIB :
G06F 21/52 (2013.01), G06F 21/55 (2013.01)
Déposants : OBERTHUR CARD SYSTEMS SA [FR/FR]; 102, Boulevard Malesherbes, F-75017 PARIS (FR) (Tous Sauf US).
GIRAUD, Christophe [FR/FR]; (FR) (US Seulement).
THIEBEAULD DE LA CROUEE, Hugues [FR/FR]; (FR) (US Seulement)
Inventeurs : GIRAUD, Christophe; (FR).
THIEBEAULD DE LA CROUEE, Hugues; (FR)
Mandataire : SANTARELLI; 14, Avenue de la Grande Armée, BP 237, F-75822 PARIS Cedex 17 (FR)
Données relatives à la priorité :
0411317 22.10.2004 FR
Titre (EN) PROTECTION AGAINST ATTACKS BY GENERATION OF ERRORS ON JUMP INSTRUCTIONS
(FR) PROTECTION CONTRE LES ATTAQUES PAR GENERATION DE FAUTES SUR LES INSTRUCTIONS DE SAUT
Abrégé : front page image
(EN)A method for securing a program against attacks by error, i.e. in a chip card, wherein at least one jump instruction, comprising a relative address chosen from a plurality of possible relative addresses, is identified in said program, wherein the at least one jump instruction makes it possible to reach a targeted address inside the memory area extending before and after said jump instruction and regrouping said plurality of possible relative addresses, inside said memory area, wherein an instruction to be preserved is identified and, in order to secure at least said instruction, at least one first non-operative batch comprising at least one instruction is inserted, said insertion being carried out in such a way as to ensure that said insertion is compatible with maintenance of the address targeted by the jump instruction inside the memory area and that said insertion is compatible with the normal running of the program.
(FR)Un procédé pour sécuriser un programme contre des attaques par faute, notamment dans une carte à puce, selon lequel, on identifie dans ce programme au moins une instruction de saut comportant une adresse relative choisie parmi une pluralité d'adresses relatives possibles, ladite au moins une instruction de saut permettant d'atteindre une adresse visée au sein d'une zone mémoire s'étendant avant et après cette instruction de saut et regroupant cette pluralité d'adresses relatives possibles, au sein de cette zone mémoire, on identifie une instruction à préserver et, pour sécuriser au moins cette instruction, on insère au moins un premier lot non opérant comportant au moins une instruction, cette insertion étant réalisée de telle sorte que cette insertion est compatible avec le maintien de l'adresse visée par l'instruction de saut à l'intérieur de la zone mémoire, et cette insertion est compatible avec le déroulement normal du programme.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KM, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, LY, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NG, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, LV, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : français (FR)
Langue de dépôt : français (FR)