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1. (WO2005083568) APPAREIL ET PROCEDE PERMETTANT DE MAINTENIR L'INTEGRITE DES DONNEES APRES UNE DETECTION D'ERREUR DE PARITE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2005/083568    N° de la demande internationale :    PCT/US2005/002044
Date de publication : 09.09.2005 Date de dépôt international : 21.01.2005
CIB :
G06F 11/07 (2006.01)
Déposants : INTEL CORPORATION [US/US]; 2200 Mission College Boulevard, Santa Clara, CA 95052 (US) (Tous Sauf US).
JOSHI, Aniruddha [IN/US]; (US) (US Seulement).
LEE, John [US/US]; (US) (US Seulement).
EDIRISOORIYA, Geetani [LK/US]; (US) (US Seulement)
Inventeurs : JOSHI, Aniruddha; (US).
LEE, John; (US).
EDIRISOORIYA, Geetani; (US)
Mandataire : VINCENT, Lester, J.; Blakely, Sokoloff, Taylor & Zafman, 12400 Wilshire Boulevard, 7th Floor, Los Angeles, CA 90025 (US)
Données relatives à la priorité :
10/779,140 13.02.2004 US
Titre (EN) AN APPARATUS AND METHOD FOR MAINTAINING DATA INTEGRITY FOLLOWING PARITY ERROR DETECTION
(FR) APPAREIL ET PROCEDE PERMETTANT DE MAINTENIR L'INTEGRITE DES DONNEES APRES UNE DETECTION D'ERREUR DE PARITE
Abrégé : front page image
(EN)In some embodiments, a method and apparatus for maintaining data integrity following parity error detection are described. In one embodiment, the method includes the blockage of bus transactions in response to detection of a parity error. Once bus transactions are suspended, a parity error handler routine is invoked to perform parity error recovery according to stored transaction information regarding an error bus transaction of the detected parity error. In one embodiment, the stored information includes a bus master that caused the error, as well as an address associated with the corrupt data for which the parity error was asserted. In one embodiment, data logging is performed to track the bus masters associated with error bus transactions to enable identification of problematic or old hardware devices. Other embodiments are described and claims.
(FR)Dans certains modes de réalisation, l'invention concerne un procédé et un appareil permettant de maintenir l'intégrité des données après une détection d'erreur de parité. Dans un mode de réalisation, ce procédé consiste à bloquer des transactions de bus en réponse à la détection d'une erreur de parité. Une fois que les transactions de bus sont suspendues, une routine de gestionnaire d'erreur de parité est appelée pour effectuer une récupération d'erreur de parité en fonction des informations de transactions stockées, relatives à la transaction de bus erronée de l'erreur de parité détectée. Dans un mode de réalisation, les informations stockées contiennent le maître de bus qui a provoqué l'erreur, ainsi qu'une adresse associée aux données altérées pour lesquelles l'erreur de parité a été détectée. Dans un mode de réalisation, un enregistrement chronologique des données est réalisé pour suivre les maîtres de bus associés aux transactions de bus erronées, ce qui permet d'identifier des dispositifs matériels trop vieux ou problématiques.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)