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1. (WO2005069098) REFERENCE DE TENSION A BANDE INTERDITE A FAIBLE DECALAGE
Dernières données bibliographiques dont dispose le Bureau international

N° de publication : WO/2005/069098 N° de la demande internationale : PCT/EP2005/050047
Date de publication : 28.07.2005 Date de dépôt international : 06.01.2005
CIB :
G05F 3/30 (2006.01)
G PHYSIQUE
05
COMMANDE; RÉGULATION
F
SYSTÈMES DE RÉGULATION DES VARIABLES ÉLECTRIQUES OU MAGNÉTIQUES
3
Systèmes non rétroactifs pour la régulation des variables électriques par l'utilisation d'un élément non commandé, ou d'une combinaison d'éléments non commandés, un tel élément ou une telle combinaison étant propre à exercer par lui-même une régulation
02
Régulation de la tension ou du courant
08
là où la tension ou le courant sont continus
10
utilisant des dispositifs non commandés à caractéristiques non linéaires
16
consistant en des dispositifs à semi-conducteurs
20
en utilisant des combinaisons diode-transistor
30
Régulateurs utilisant la différence entre les tensions base-émetteur de deux transistors bipolaires fonctionnant à des densités de courant différentes
Déposants :
ANALOG DEVICES, INC. [US/US]; One Technology Way Norwood, MA 02062, US (AllExceptUS)
MARINCA, Stefan [RO/IE]; IE (UsOnly)
Inventeurs :
MARINCA, Stefan; IE
Mandataire :
MOORE, Barry ; 11 Mespil Road Dublin, 4, IE
Données relatives à la priorité :
10/756,15513.01.2004US
Titre (EN) A LOW OFFSET BANDGAP VOLTAGE REFERENCE
(FR) REFERENCE DE TENSION A BANDE INTERDITE A FAIBLE DECALAGE
Abrégé :
(EN) The invention provides a bandgap voltage reference circuit that is adapted to provide a &Dgr; Vbe of sufficiently large value that no amplification is required, and therefore any offset contribution is not gained. Using a stacked arrangement of three pairs of transistors, the invention reduces the requirement for multiple resistors within a circuit and can therefore minimize errors due to resistor matching and value. Internally provided circuitry for reducing voltage curvature is provided with the result that a circuit having low offset sensitivity and curvature correction is provided.
(FR) La présente invention a trait à un circuit de référence de tension à bande interdite à faible décalage adapté à fournir une différence de tension $g(D) Vbe de valeur suffisamment grande qu'aucune amplification n'est nécessaire, et donc il n'y a aucun gain de contribution de décalage. Grâce à l'utilisation d'un agencement empilé de trois paires de transistors, l'invention réduit la nécessité de résistances multiples au sein d'un circuit et peut donc minimiser les erreurs dues à l'appariement et la valeur des résistances. Il est prévu de manière interne un circuit pour la réduction de courbure de tension, ce qui permet l'obtention d'un circuit ayant une sensibilité de décalage faible et une correction de courbure.
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États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SM, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IS, IT, LT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
Langue de publication : Anglais (EN)
Langue de dépôt : Anglais (EN)
Également publié sous:
JP2007518173US20050151528US20070170906JP4616281CN1947079