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1. (WO2005010748) ORGANISATION DE LA MEMOIRE PERMETTANT UN ADRESSAGE DE POINTEUR PAS A PAS, L'ADRESSE DU POINTEUR ETANT EGALEMENT CONTENUE DANS UN DES EMPLACEMENTS MEMOIRE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2005/010748    N° de la demande internationale :    PCT/IB2004/051302
Date de publication : 03.02.2005 Date de dépôt international : 27.07.2004
CIB :
G06F 9/30 (2006.01), G06F 9/35 (2006.01)
Déposants : KONINKLIJKE PHILIPS ELECTRONICS, N.V. [NL/NL]; Groenewoudseweg 1, NL-5621 BA Eindhoven (NL) (Tous Sauf US).
GOODHUE, Gregory [US/US]; (US) (US Seulement).
KHAN, Ata [US/US]; (US) (US Seulement).
DING, Zhimin [US/US]; (US) (US Seulement)
Inventeurs : GOODHUE, Gregory; (US).
KHAN, Ata; (US).
DING, Zhimin; (US)
Représentant
commun :
KONINKLIJKE PHILIPS ELECTRONICS, N.V.; c/o Waxler, Aaron, P.O. Box 3001, Briarcliff Manor, NY 10510-8001 (NL)
Données relatives à la priorité :
60/490,954 30.07.2003 US
Titre (EN) MEMORY ORGANIZATION ALLOWING SINGLE CYCLE POINTER ADDRESSING WHERE THE ADDRESS OF THE POINTER IS ALSO CONTAINED IN ONE OF THE MEMORY LOCATIONS
(FR) ORGANISATION DE LA MEMOIRE PERMETTANT UN ADRESSAGE DE POINTEUR PAS A PAS, L'ADRESSE DU POINTEUR ETANT EGALEMENT CONTENUE DANS UN DES EMPLACEMENTS MEMOIRE
Abrégé : front page image
(EN)All Pointer-based accesses require first that the value contained in a pointer register (200a, 200b, 200c, 200d) to be read and then that value be used as an address to the appropriate region in random access memory (RAM) (104). As implemented today, this requires two memory read access cycles, each of which takes at least one clock cycle and therefore this implementation does not allow single cycle operation. In accordance with an embodiment of the invention, when an access is performed to pointer memory (103 a, 103b, 103c, 103d) to read the contents of a pointer, it is the shadow memory that is actually read and that returns the pointer value. Since the shadow memory is made up of pointer registers (200a, 200b, 200c, 200d), a read access involves mutliplexing out of appropriate data for the pointer address from these pointer registers (200a, 200b, 200c, 200d) to form a target pointer address. This target pointer address is then used as an address to access RAM (104) without the overhead of a clock, since the register access is purely combinatorial and does not require clock-phase related timing as does access to the RAM (104).
(FR)Tous les accès pilotés par pointeur exigent que la valeur contenue dans un registre de pointeurs (200a, 200b, 200c, 200d) soit tout d'abord lue et ensuite utilisée comme adresse d'accès à la région appropriée dans la mémoire vive (RAM) (104). Dans le cadre de l'implémentation actuelle, cette procédure nécessite deux cycles d'accès en lecture à la mémoire, dont chacun occupe au moins un cycle d'horloge, et par conséquent cette implémentation ne permet pas une exécution pas à pas. Selon un mode de réalisation de l'invention, lors d'un accès à la mémoire de pointeurs (103 a, 103b, 103c, 103d) pour lire le contenu d'un pointeur, c'est la mémoire fantôme qui en réalité est lue et restitue la valeur du pointeur. Cette mémoire fantôme étant constituée de registres de pointeurs (200a, 200b, 200c, 200d), un accès en lecture implique un multiplexage sur la base des données appropriées de l'adresse de pointeur provenant de ces registres de pointeurs (200a, 200b, 200c, 200d), en vue de former une adresse de pointeur cible. Il est ensuite possible d'utiliser cette adresse de pointeur cible comme adresse pour accéder à la mémoire vive (104) tout en s'affranchissant d'une horloge, puisque l'accès aux registres est purement combinatoire et ne nécessite pas un cadencement lié à une phase d'horloge, à la différence de l'accès à la mémoire vive (104).
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, NA, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)