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Paramétrages

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1. WO2005001724 - PROCEDE DE PROGRAMMATION D'UN DISPOSITIF LOGIQUE PROGRAMMABLE PAR MASQUE ET DISPOSITIF AINSI PROGRAMME

Numéro de publication WO/2005/001724
Date de publication 06.01.2005
N° de la demande internationale PCT/US2004/020362
Date du dépôt international 23.06.2004
CIB
G06F 17/50 2006.01
GPHYSIQUE
06CALCUL; COMPTAGE
FTRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
17Équipement ou méthodes de traitement de données ou de calcul numérique, spécialement adaptés à des fonctions spécifiques
50Conception assistée par ordinateur
CPC
G06F 30/30
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
30Computer-aided design [CAD]
30Circuit design
G06F 30/34
GPHYSICS
06COMPUTING; CALCULATING; COUNTING
FELECTRIC DIGITAL DATA PROCESSING
30Computer-aided design [CAD]
30Circuit design
34for reconfigurable circuits, e.g. field programmable gate arrays [FPGA] or programmable logic devices [PLD]
Déposants
  • ALTERA CORPORATION [US/US]; 101 Innovation Drive San Jose, CA 95134-1941, US (AllExceptUS)
  • PERRY, Steven [GB/GB]; GB (UsOnly)
  • NIXON, Gregor [GB/GB]; GB (UsOnly)
  • KONG, Larry [GB/GB]; GB (UsOnly)
  • SCOTT, Alasdair [GB/GB]; GB (UsOnly)
  • HALL, Andrew [GB/GB]; GB (UsOnly)
  • WANG, Lingli [CN/GB]; GB (UsOnly)
  • DETTMAR, Chris [GB/GB]; GB (UsOnly)
  • PARK, Jonathan [US/US]; US (UsOnly)
  • PRICE, Richard [GB/US]; US (UsOnly)
Inventeurs
  • PERRY, Steven; GB
  • NIXON, Gregor; GB
  • KONG, Larry; GB
  • SCOTT, Alasdair; GB
  • HALL, Andrew; GB
  • WANG, Lingli; GB
  • DETTMAR, Chris; GB
  • PARK, Jonathan; US
  • PRICE, Richard; US
Mandataires
  • JACKSON, Robert, R. ; c/o Fish & Neave 1251 Avenue of the Americas New York, NY 10020, US
Données relatives à la priorité
60/480,91723.06.2003US
60/483,52526.06.2003US
Langue de publication anglais (EN)
Langue de dépôt anglais (EN)
États désignés
Titre
(EN) METHOD FOR PROGRAMMING A MASK-PROGRAMMABLE LOGIC DEVICE AND DEVICE SO PROGRAMMED
(FR) PROCEDE DE PROGRAMMATION D'UN DISPOSITIF LOGIQUE PROGRAMMABLE PAR MASQUE ET DISPOSITIF AINSI PROGRAMME
Abrégé
(EN)
A user logic design for a mask-programmable logic device ('MPLD') may be designed on a comparable or compatible user-programmable logic device ('UPLD') and migrated to the MPLD, or may be designed directly on an MPLD. If the design is designed on a UPLD, the constraints of the target MPLD i.e., differences between the devices are taken into account so that the migration will be successful. If the design is designed directly on an MPLD, constraints of a comparable compatible UPLD are taken into account if the user indicates that the design will be migrated to the UPLD for testing. This means that when a logic design is intended to be migrated back-and-forth between a UPLD and an MPLD, only the intersection of features can be used. To facilitate migration, fixed mappings between pairs of devices may be created.
(FR)
Une structure logique d'utilisateur pour un dispositif logique programmable par masque ('MPLD') peut être conçue sur un dispositif logique programmable par utilisateur ('UPLD') comparable ou compatible et être migrée vers le MPLD, ou bien être conçue directement sur un MPLD. Si la structure est conçue sur un UPLD, les contraintes du MPLD cible, c'est-à-dire, des différences entre les dispositifs, sont prises en compte de manière que la migration puisse être réussie. Si la structure est conçue directement sur un MPLD, les contraintes d'un UPLD comparable ou compatible sont prises en compte si l'utilisateur indique que la structure sera migrée au UPLD pour essai. Ceci signifie que lorsqu'une structure logique est destinée à être migrée vers l'avant et vers l'arrière entre un UPLD et un MPLD, seule l'intersection de caractéristiques peut être utilisée. Pour faciliter la migration, des mappages fixes entre des paires de dispositifs peuvent être créés.
Également publié en tant que
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