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1. (WO2004097608) CIRCUIT DE REINITIALISATION ET SON DISPOSITIF DE COMMUNICATION NUMERIQUE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2004/097608    N° de la demande internationale :    PCT/JP2004/005859
Date de publication : 11.11.2004 Date de dépôt international : 23.04.2004
Demande présentée en vertu du Chapitre 2 :    09.12.2004    
CIB :
G06F 1/24 (2006.01)
Déposants : NEC CORPORATION [JP/JP]; 7-1, Shiba 5-chome Minato-ku, Tokyo 108-8001 (JP) (Tous Sauf US).
ISHIKAWA, Yasuaki [JP/JP]; (JP) (US Seulement)
Inventeurs : ISHIKAWA, Yasuaki; (JP)
Mandataire : KATO, Asamichi; c/o A. Kato & Associates Bohsei Bldg., 7th Floor 20-12, Shin-Yokohama 3-chome Kohoku-ku, Yokohama-shi Kanagawa 222-0033 (JP)
Données relatives à la priorité :
2003-121721 25.04.2003 JP
Titre (EN) RESET CIRCUIT AND DIGITAL COMMUNICATION DEVICE
(FR) CIRCUIT DE REINITIALISATION ET SON DISPOSITIF DE COMMUNICATION NUMERIQUE
(JA) リセット回路とディジタル通信装置
Abrégé : front page image
(EN)It is possible to surely perform reset operation without requiring constant adjustment of pull-up resistance of a reset trigger signal. Moreover, even when the clock is in stop state when power is turned ON, the reset is released. During normal operation, a clock stop detection signal CALMB becomes H and the reset trigger signal CPURSTB is masked by an OR gate circuit (8). When the clock stops and the CALMB becomes L during normal operation, the CPURSTB passes through the OR gate circuits (6, 8) and an AND gate circuit (10) and is output as a reset output signal RSTB. In case the clock is in stop state when power is turned ON, i.e., when the CALMB is L when the external power on reset signal PRSTB is changed from L to H, a mask signal MASK output from a latch circuit (2) remains H and the RSTB masked by the OR gate circuit (6) is not kept asserted even if the CPURSTB becomes L.
(FR)Il est possible d'effectuer une opération de réinitialisation sans qu'il soit nécessaire d'avoir recours à un réglage constant de résistance à la traction d'un signal de déclenchement de réinitialisation. En outre, lorsque l'horloge est dans un état d'arrêt, lorsque l'alimentation est sur ON, la réinitialisation est lancée. Lors du fonctionnement normal, un signal de détection d'arrêt d'horloge CALMB devient H et le signal de déclenchement de réinitialisation CPURSTB est masqué par un circuit de grille OR (8). Lorsque l'horloge s'arrête et que le CALMB devient L en fonctionnement normal, le CPURSTB passe dans les circuits de grille OR (6, 8) et dans un circuit de grille AND (10) puis ressort en tant que signal de sortie de réinitialisation RSTB. Dans le cas où l'horloge est dans un état d'arrêt, lorsque l'alimentation est sur ON, à savoir, lorsque le CALMB est L, lorsque la puissance extérieure sur le signal de réinitialisation PRSTB change de L à H, une sortie MASK de signal de masque provenant d'un circuit de verrouillage (2) reste H, et le RSTB masqué par le circuit de grille OR (6) reste non affirmé, même si le CPURSTB devient L.
(JA)リセットトリガ信号のプルアップ抵抗の定数調整を必要とせずに確実にリセット動作を行う。また、電源投入時にクロックが停止している場合でもリセットを解除する。通常動作中は、クロック停止検出信号CALMBがHとなりリセットトリガ信号CPURSTBはORゲート回路8によりマスクされる。通常動作中にクロックが停止してCALMBがLとなると、CPURSTBはORゲート回路6、8、ANDゲート回路10を通過してリセット出力信号RSTBとして出力される。電源動作投入時にクロックが停止している場合、つまり外部パワーオンリセット信号PRSTBがLからHへ変化した時にCALMBがLの場合、ラッチ回路2のから出力されるマスク信号MASKはHのままとなり、CPURSTBがLとなった場合でも、ORゲート回路6によりマスクされRSTBがアサートされたままとならない。
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BW, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NA, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, US, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)