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1. (WO2004062111) DECODEUR A TURBO-CODES GRANDE VITESSE POUR ARCHITECTURE 3G UTILISANT DES DECODEURS SISO LOG-MAP PIPELINE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2004/062111    N° de la demande internationale :    PCT/US2003/035865
Date de publication : 22.07.2004 Date de dépôt international : 07.11.2003
CIB :
H03M 13/29 (2006.01)
Déposants : ICOMM TECHNOLOGIES, INC. [US/US]; Great Valley Corporate Center, 7 Great Valley Parkway, Suite 210, Malvern, PA 19355 (US)
Inventeurs : NGUYEN, Quang; (US)
Données relatives à la priorité :
10/248,245 30.12.2002 US
Titre (EN) HIGH SPEED TURBO CODES DECODER FOR 3G USING PIPELINED SISO LOG-MAP DECODERS ARCHITECTURE
(FR) DECODEUR A TURBO-CODES GRANDE VITESSE POUR ARCHITECTURE 3G UTILISANT DES DECODEURS SISO LOG-MAP PIPELINE
Abrégé : front page image
(EN)The invention encompasses several improved Turbo Codes Decoder method and apparatus to provide a more suitable, practical and simpler method for implementing a Turbo Codes Decoder in ASIC or DSP codes. (1) Two Parallel Turbo Codes Decoder blocks (40A & 40B) to compute soft-decoded data RXDa, RXDb from two different received path. (2) Two pipelined Log-MAP decoders (A42 & B44) are used for iterative decoding received data. (3) A Sliding Window of block N data are used on the input memory for pipeline operations. (4) The output Block N Data from the first decoder A are stored in the RAM memory A, and the second decoder B stores output data in the RAM memory B while the decoder B decodes block N data from RAM memory A at the same clock cycle. (5) Log-Map decoders are simpler to implement and are low-power consumption. (6) Pipelined log-Map decoder’s architecture provides high-speed data throughout, one output per clock cycle.
(FR)L'invention concerne plusieurs procédés et appareils décodeurs à turbo-codes améliorés fournissant un procédé pratique, simplifié et mieux approprié pour la mise en oeuvre d'un décodeur à turbo-codes en codes ASIC ou DSP. (1) Deux blocs décodeurs à turbo-codes parallèles (40A & 40B) sont utilisés pour calculer des données décodées à décodage pondéré RXDa, RXDb provenant de deux différents parcours reçus. (2) Deux décodeurs Log-MAP pipe-line (A42 & B44) sont utilisés pour le décodage itératif des données reçues. (3) Des données à fenêtre glissante de bloc N sont utilisées sur la mémoire entrée pour des opérations pipeline. (4) Les données bloc N de sortie provenant du premier décodeur A sont mémorisées dans la mémoire A RAM, et le second décodeur B mémorise des données de sortie dans la mémoire B RAM, cependant que le décodeur B décode des données du bloc N provenant de la mémoire A RAM, au même cycle d'horloge. (5) Des décodeurs Log-Map sont plus simples à mettre en oeuvre et sont à faible consommation d'énergie. (6) L'architecture du décodeur log-Map pipeline fournit un débit de données grande vitesse, une sortie par cycle d'horloge.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, EG, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NI, NO, NZ, OM, PG, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, SY, TJ, TM, TN, TR, TT, TZ, UA, UG, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (BW, GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)