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1. (WO2003081400) SYSTEME DE SECURITE DE CIRCUIT INTEGRE ET PROCEDE DE SECURITE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2003/081400    N° de la demande internationale :    PCT/US2003/007839
Date de publication : 02.10.2003 Date de dépôt international : 14.03.2003
Demande présentée en vertu du Chapitre 2 :    19.09.2003    
CIB :
G06F 1/00 (2006.01), G06F 12/14 (2006.01), H04L 9/32 (2006.01)
Déposants : FREESCALE SEMICONDUCTOR, INC. [US/US]; 6501 William Cannon Drive West, Austin, TX 78735 (US)
Inventeurs : MOYER, William, C.; (US).
FITZSIMMONS, Michael, D.; (US)
Mandataire : KING, Robert, L.; Freescale Semiconductor, Inc., 7700 West Parmer Lane, MD: TX32/PL02, Austin, TX 78729-8084 (US)
Données relatives à la priorité :
10/100,462 18.03.2002 US
Titre (EN) INTEGRATED CIRCUIT SECURITY AND METHOD THEREFOR
(FR) SYSTEME DE SECURITE DE CIRCUIT INTEGRE ET PROCEDE DE SECURITE
Abrégé : front page image
(EN)The invention relates to an integrated circuit (IC), and more particularly to security to protect an IC (10) against unauthorized accesses. In one embodiment, an identifier is provided external to IC 10. A corresponding input IC security key (52) is then provided to IC 10 and compared to a stored IC security key (30). If the input IC security key (52) and the stored IC security key (30) do not match, access to protected functional circuitry (12) is prohibited. The present invention may use any debug interface, including standard debug interfaces using the JTAG 1149.1 interface defined by the IEEE.
(FR)L'invention concerne un circuit intégré, et plus particulièrement, un système de sécurité pour protéger un circuit intégré (10) contre les accès non autorisés. Selon un mode de réalisation, un identifiant est fourni à l'extérieur du circuit intégré (10). Un code de sécurité (52) du circuit intégré d'entrée est ensuite fourni au circuit intégré (10) et comparé à un code de sécurité de circuit intégré mémorisé (30). Si ce code de sécurité (52) du circuit intégré d'entrée et le code de sécurité du circuit intégré mémorisé (30) ne correspondent pas, l'accès au circuit fonctionnel protégé (12) est interdit. La présente invention peut utiliser toute interface de mise au point, y compris des interfaces de mise au point standards, utilisant l'interface JTAG 1149.1 définie par la norme IEEE.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NI, NO, NZ, OM, PH, PL, PT, RO, RU, SC, SD, SE, SG, SK, SL, TJ, TM, TN, TR, TT, TZ, UA, UG, UZ, VC, VN, YU, ZA, ZM, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, BG, CH, CY, CZ, DE, DK, EE, ES, FI, FR, GB, GR, HU, IE, IT, LU, MC, NL, PT, RO, SE, SI, SK, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)