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1. (WO2002093821) DISPOSITIF DESTINE A TESTER LA CONFORMITE D'UNE CONNEXION ELECTRONIQUE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/093821    N° de la demande internationale :    PCT/IB2002/001695
Date de publication : 21.11.2002 Date de dépôt international : 15.05.2002
CIB :
H04L 1/24 (2006.01)
Déposants : KONINKLIJKE PHILIPS ELECTRONICS N.V. [NL/NL]; Groenewoudseweg 1, NL-5621 BA Eindhoven (NL) (Tous Sauf US).
REBERGA, Jacques [FR/NL]; (NL) (US Seulement)
Inventeurs : REBERGA, Jacques; (NL)
Mandataire : LANDOUSY, Christian; Internationaal Octrooibureau B.V., Prof. Holstlaan 6, NL-5656 AA Eindhoven (NL)
Données relatives à la priorité :
01/06394 15.05.2001 FR
Titre (EN) DEVICE FOR TESTING THE CONFORMITY OF AN ELECTRONIC CONNECTION
(FR) DISPOSITIF DESTINE A TESTER LA CONFORMITE D'UNE CONNEXION ELECTRONIQUE
Abrégé : front page image
(EN)A device for testing the conformity of an electronic connection (1), the device comprising a first signal generator (3) supplying a sequence of input bits to a first extremity (E) of the connection (1), and an error detection device (6) receiving a sequence of output bits from a second extremity (S) of the connection (1), in response to the sequence of input bits. The error detection device (6) comprises: a second signal generator (10) intended to recreate the sequence of input bits and being suitable for predicting the value of the next bit when the second extremity (S) supplies a bit of the output sequence, and information means (14) indicating the presence of an error with means (13) for comparing the value of the predicted bit with the effective value of the next bit of the sequence of output bits. Application: notably for testing integrated circuits.
(FR)L'invention concerne un dispositif destiné à tester la conformité d'une connexion électronique (1), ce dispositif comprenant un premier générateur de signal (3) délivrant une séquence de bits d'entrée à une première extrémité (E) de la connexion (1), et un dispositif de détection d'erreur (6) recevant une séquence de bits de sortie provenant d'une seconde extrémité (S) de la connexion (1), en réponse à la séquence de bits d'entrée. Le dispositif de détection d'erreur (6) comprend: un second générateur de signal (10) censé recréer la séquence des bits d'entrée et état adapté à prédire la valeur du bit suivant lorsque la seconde extrémité (S) délivre un bit de la séquence de sortie, et des moyens d'information (14) indiquant la présence d'une erreur à l'aide de moyens (13) destinés à comparer la valeur du bit prédit avec la valeur effective du bit suivant de la séquence de bits de sortie. L'application de l'invention concerne notamment les tests de circuits intégrés.
États désignés : JP, US.
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)