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1. (WO2002082246) CIRCUIT DE REINITIALISATION ET PROCEDE S'Y RAPPORTANT
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/082246    N° de la demande internationale :    PCT/IB2002/001096
Date de publication : 17.10.2002 Date de dépôt international : 05.04.2002
CIB :
G06F 1/24 (2006.01)
Déposants : KONINKLIJKE PHILIPS ELECTRONICS N.V. [NL/NL]; Groenewoudseweg 1, NL-5621 BA Eindhoven (NL)
Inventeurs : JENSEN, Rune; (NL)
Mandataire : DUIJVESTIJN, Adrianus, J.; Internationaal Octrooibureau B.V., Prof. Holstlaan 6, NL-5656 AA Eindhoven (NL)
Données relatives à la priorité :
09/826,570 05.04.2001 US
Titre (EN) RESET CIRCUIT AND METHOD THEREFOR
(FR) CIRCUIT DE REINITIALISATION ET PROCEDE S'Y RAPPORTANT
Abrégé : front page image
(EN)According to one example embodiment of the present invention, a reset method and system are used to effect a reset at several peripheral devices that may employ similar and/or different reset strategies. A reset signal generator is coupled to a clock module having an external clock reference and to each of the peripheral devices. A reset clock signal having the reference clock frequency is sent to each of the peripheral devices via clock outputs at the clock module. A synchronization module at each of the peripheral devices is adapted to synchronize the reset signal among all peripheral devices using the clock signal. The clock module holds the reset clock signal for a selected amount of time, and then releases the signal from the external clock. The reset signals are then simultaneously released at each of the peripheral devices, making possible a smooth transition from reset.
(FR)L'opérabilité et l'évolutivité de circuits électroniques sont améliorées par l'utilisation d'un montage de circuits modulaire, évolutif, facile à mettre en oeuvre, et qui permet une application conceptuelle physique simple et sûre. Dans une forme de réalisation exemplaire, un procédé et un système de réinitialisation sont utilisés pour effectuer une remise à zéro au niveau de plusieurs dispositifs périphériques pouvant employer des stratégies de réinitialisation similaires et/ou différentes. Un émetteur de signaux de remise à zéro est couplé, d'une part à un module d'horloge présentant une référence d'horloge externe, d'autre part à chaque dispositif périphérique. Un signal d'horloge de remise à zéro possédant une fréquence d'horloge de référence est envoyé à chaque dispositif périphérique par des sorties de la base de temps au niveau du module d'horloge. Un module de synchronisation intégré à chaque dispositif périphérique est configuré pour synchroniser le signal de remise à zéro de tous les dispositifs périphériques au moyen du signal d'horloge. Le module d'horloge retient le signal de remise à zéro pendant un laps de temps déterminé, puis libère le signal de l'horloge externe. Les signaux de remise à zéro sont ensuite libérés simultanément au niveau chaque dispositif périphérique, ce qui assure une transition sans heurt après réinitialisation.
États désignés : JP.
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)