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1. (WO2002080373) PROCEDES ET DISPOSITIFS DESTINES A CONVERTIR ET DECODER UN FLOT DE BITS DE DONNEES, SIGNAL ET SUPPORT D'ENREGISTREMENT
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/080373    N° de la demande internationale :    PCT/IB2002/001049
Date de publication : 10.10.2002 Date de dépôt international : 25.03.2002
CIB :
H03M 5/14 (2006.01), H03M 13/00 (2006.01), H03M 13/09 (2006.01)
Déposants : KONINKLIJKE PHILIPS ELECTRONICS N.V. [NL/NL]; Groenewoudseweg 1, NL-5621 BA Eindhoven (NL)
Inventeurs : COENE, Willem, M., J., M.; (NL).
POZIDIS, Charalampos; (NL).
BERGMANS, Johannes, W., M.; (NL)
Mandataire : DEGUELLE, Wilhelmus, H., G.; Internationaal Octrooibureau B.V., Prof. Holstlaan 6, NL-5656 AA Eindhoven (NL)
Données relatives à la priorité :
0107950.8 30.03.2001 GB
01203428.6 11.09.2001 EP
Titre (EN) METHODS AND DEVICES FOR CONVERTING AS WELL AS DECODING A STREAM OF DATA BITS, SIGNAL AND RECORD CARRIER
(FR) PROCEDES ET DISPOSITIFS DESTINES A CONVERTIR ET DECODER UN FLOT DE BITS DE DONNEES, SIGNAL ET SUPPORT D'ENREGISTREMENT
Abrégé : front page image
(EN)The invention relates to methods and devices for converting a stream of data bits of a binary information signal (2) into a stream of data bits of a constrained binary channel signal (3) using multiple channel codes C¿st?, C¿pc?. Apart from a standard code C¿st?, that is designed for a high coding rate, a parity-check enabling code C¿pc? is used that allows realization of a certain, predefined parity-check constraint imposed on the constrained binary channel signal (3). This parity-check constraint is related to a predetermined error event of the channel. The amount of use of the parity-check enabling code C¿pc? is dependent on the need for preventing the certain error event. Also another channel code C¿sub? can be used in this method in order to realise DC-control. The invention further relates to a corresponding signal, record carrier as well as a method and device for decoding.
(FR)L'invention concerne des procédés et des dispositifs destinés à convertir un flot de bits de données d'un signal d'information binaire (2) en un flot de bits de données d'un signal de canal binaire contraint (3) au moyen de codes de canaux multiples (C¿st?, C¿pc?). Outre un code standard (C¿st?) adapté à une vitesse de codage élevée, on utilise un code de validation à contrôle de parité (C¿pc?) permettant la réalisation d'une certaine contrainte de contrôle de parité prédéfinie imposée au signal de canal binaire contraint (3). Cette contrainte de contrôle de parité est associée à un événement d'erreur prédéterminé du canal. La fréquence d'utilisation du code de validation à contrôle de parité (C¿pc?) dépend de la nécessité de prévenir un certain événement d'erreur. Dans ce procédé, on peut également utiliser un autre code de canal (C¿sub?) en vue de réaliser une commande à courant continu. L'invention concerne également un signal correspondant, un support d'enregistrement ainsi qu'un procédé et un dispositif de décodage.
États désignés : CN, IN, JP, KR.
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)