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1. (WO2002077846) SYSTEME ET PROCEDE DE SYNCHRONISATION DE DONNEES POUR UNE ARCHITECTURE D'ORDINATEUR POUR RESEAUX A LARGE BANDE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/077846    N° de la demande internationale :    PCT/JP2002/002605
Date de publication : 03.10.2002 Date de dépôt international : 19.03.2002
Demande présentée en vertu du Chapitre 2 :    26.07.2002    
CIB :
H04L 29/06 (2006.01)
Déposants : SONY COMPUTER ENTERTAINMENT INC. [JP/JP]; 2-6-21 Minami-aoyama Minato-ku, Tokyo 107-0062 (JP)
Inventeurs : SUZUOKI, Masakazu; (JP).
YAMAZAKI, Takeshi; (US)
Mandataire : SUZUKI, Seigoh; Shiba NK Bldg. 4th Floor 22-7, Shiba 3-chome Minato-ku, Tokyo 105-0014 (JP)
Données relatives à la priorité :
09/815,554 22.03.2001 US
Titre (EN) SYSTEM AND METHOD FOR DATA SYNCHRONIZATION FOR A COMPUTER ARCHITECTURE FOR BROADBAND NETWORKS
(FR) SYSTEME ET PROCEDE DE SYNCHRONISATION DE DONNEES POUR UNE ARCHITECTURE D'ORDINATEUR POUR RESEAUX A LARGE BANDE
Abrégé : front page image
(EN)A computer architecture and programming model for high speed processing over broadband networks are provided. The architecture employs a consistent modular structure, a common computing module and uniform software cells. The common computing module includes a control processor, a plurality of processing units, a plurality of local memories from which the processing units process programs, a direct memory access controller and a shared main memory. A synchronized system and method for the coordinated reading and writing of data to and from the shared main memory by the processing units also are provided. A hardware sandbox structure is provided for security against the corruption of data among the programs being processed by the processing units. The uniform software cells contain both data and applications and are structured for processing by any of the processors of the network.
(FR)L'invention concerne une architecture d'ordinateur et un modèle de programmation pour le traitement à grande vitesse sur des réseaux à large bande. Cette architecture comprend une structure modulaire consistante, un module de calcul commun et des cellules logicielles uniformes. Le module de calcul commun comprend un processeur de commande, plusieurs unités de traitement, plusieurs mémoires locales à partir desquelles les unités de traitement traitent des programmes, un contrôleur d'accès direct en mémoire et une mémoire principale partagée. Un système et un procédé synchronisés pour la lecture et l'écriture coordonnées de données dans la mémoire principale partagée par les unités de traitement sont également prévus. Une structure matérielle de type « bac à sable » est utilisée à des fins de sécurité contre la corruption des données parmi les programmes traités par les unités de traitement. Les cellules logicielles uniformes contiennent des données et des applications et sont structurées pour un traitement par n'importe quel processeur du réseau.
États désignés : AU, BR, CA, CN, IN, KR, MX, NZ, RU, SG.
Office européen des brevets (OEB) (BE, CH, DE, DK, ES, FI, FR, GB, IT, NL, SE).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)