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1. (WO2002049251) DISPOSITIF ET PROCÉDÉ DE RÉCEPTION
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/049251    N° de la demande internationale :    PCT/JP2001/010947
Date de publication : 20.06.2002 Date de dépôt international : 13.12.2001
CIB :
H04L 1/00 (2006.01), H04B 7/08 (2006.01), H04J 13/00 (2011.01), H04L 1/06 (2006.01)
Déposants : SONY CORPORATION [JP/JP]; 7-35, Kitashinagawa 6-chome Shinagawa-ku, Tokyo 141-0001 (JP) (Tous Sauf US).
TERASHIMA, Kazuhiko [JP/JP]; (JP) (US Seulement).
NAGASE, Taku [JP/JP]; (JP) (US Seulement).
NATORI, Makoto [JP/JP]; (JP) (US Seulement)
Inventeurs : TERASHIMA, Kazuhiko; (JP).
NAGASE, Taku; (JP).
NATORI, Makoto; (JP)
Mandataire : KOIKE, Akira; No.11 Mori Bldg., 6-4, Toranomon 2-chome Minato-ku, Tokyo 105-0001 (JP)
Données relatives à la priorité :
2000-379282 13.12.2000 JP
Titre (EN) RECEIVING DEVICE AND METHOD
(FR) DISPOSITIF ET PROCÉDÉ DE RÉCEPTION
Abrégé : front page image
(EN)From a received signal, reference phase information is separated and extracted by a reference phase despreading section (106) and reception data is separated and extracted by a data part despreading section (107). A weighting coefficient calculation section (115) sends a weighting coefficient according to an SNR value used as transmission line information from an SNR calculation section (114) to a multiplier (109), which determines a correction coefficient by multiplying the weighting coefficient by a phase correction value based on the reference phase information. A multiplier (111) multiplies the reception data from the data part despreading section (107) by the correction coefficient. A bit width control section (112) limits the bit width. An adder (117) adds the outputs, subjected to bit width limitation, from from coherent receiving sections (101, 121). The sum is stored in a frame buffer (118) and sent to a soft-decision input error correcting section (120). Thus, the computational complexity of weighting multiplication by a receiver that carries out coherent reception and the capacity of a memory for the frame buffer are reduced.
(FR)Selon l'invention, à partir d'un signal reçu, on sépare et on extrait des informations de phase de référence par une section de désétalement de phase de référence (106). On sépare et on extrait également des données de réception par une section de désétalement de la partie données (107). Une section de calcul du coefficient de pondération (115) envoie un coefficient de pondération en fonction d'une valeur SNR utilisée comme information de ligne de transmission provenant d'une section de calcul du SNR (114) vers un multiplicateur (109), qui détermine un coefficient de correction en multipliant le coefficient de pondération par une valeur de correction de phase fondée sur les informations de phase de référence. Un multiplicateur (111) multiplie les données de réception de la section de désétalement de la partie données (107) par le coefficient de correction. Une section de commande de largeur de bits (112) limite la largeur de bits. Un sommateur (117) additionne les résultats, sous réserve de la limitation de la largeur de bits, provenant de sections de réception cohérentes (101, 121). La somme est stockée dans une mémoire d'images (118) et envoyée à une section de correction d'erreurs d'entrée de décisions pondérées (120). Ainsi, la complexité du calcul de la multiplication de pondération par un récepteur qui effectue une réception cohérente et la capacité d'une mémoire en ce qui concerne la mémoire d'images sont réduites.
États désignés : CN, US.
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)