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1. (WO2002048849) CARTE CIRCUIT IMPRIMÉ ET SYSTÈME DE CARTE CIRCUIT IMPRIMÉ
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/048849    N° de la demande internationale :    PCT/JP2001/010926
Date de publication : 20.06.2002 Date de dépôt international : 13.12.2001
CIB :
G06K 7/00 (2006.01), G06K 19/07 (2006.01)
Déposants : SONY CORPORATION [JP/JP]; 7-35, Kitashinagawa 6-chome Shinagawa-ku, Tokyo 141-0001 (JP) (Tous Sauf US).
BANDO, Hideaki [JP/JP]; (JP) (US Seulement)
Inventeurs : BANDO, Hideaki; (JP)
Mandataire : SUGIURA, Masatomo; 7th Floor, Ikebukuro Park Bldg. 49-7, Minami Ikebukuro 2-chome Toshima-ku, Tokyo 171-0022 (JP)
Données relatives à la priorité :
2000-379590 14.12.2000 JP
Titre (EN) IC CARD AND IC CARD SYSTEM
(FR) CARTE CIRCUIT IMPRIMÉ ET SYSTÈME DE CARTE CIRCUIT IMPRIMÉ
Abrégé : front page image
(EN)When data is transmitted from a system body (11) to an IC card (12) a clock signal is input in the clock input of an FF2R via (a buffer (CK1S) $m(7) a transmission path (CLK) $m(7) a buffer (CK2R)). A data signal is output from an FF1S in synchronism with a rising edge of the clock signal, and input and captured in the data input of the FF2R via (a buffer (101S) $m(7) a transmission path (DATA) $m(7) a buffer (102R)). When data is transmitted from the IC card (12) to the system body (11), the clock signal is input in the clock input of an FF1R via (a buffer (CK2S) $m(7) the transmission path (CLK) $m(7) a buffer (CL1R)). The data signal is output from an FF2S in synchronism with a rising edge of the clock signal, and input and captured in the data input of the FF1R via (a buffer (102S) $m(7) the transmission path (DATA) $m(7) a buffer (101R)).
(FR)METHOD FOR MONITING NATURAL-WORLD DATA, AND METHOD OFMONITORING Etination d'une carte circuit imprimé (12), un signal de synchro est fourni à l'entrée synchro d'un FF2R via (un tampon (CK1S) $m(7) un chemin de transmission (CLK) $m(7) un tampon (CK2R)). Il y a production d'un signal de données en sortie d'un FF1S en synchronisme avec un flanc montant du signal de synchro, puis fourniture et capture de ce signal en entrée de données du FF2R via (un tampon (101S) $m(7) un chemin de transmission (DATA) $m(7) un tampon (102R)). Pour la transmission des données de la carte circuit imprimé (12) à destination du corps de système (11), le signal de synchro est fourni à l'entrée synchro d'un FF1R via (un tampon (CK2S) $m(7) le chemin de transmission (CLK) $m(7) un tampon (CL1R)). Il y a production du signal de sortie en sortie d'un FF2S en synchronisme avec un flanc montant du signal de synchro, puis fourniture et capture de ce signal de sortie en entrée de données du FF1R via (un tampon (102S) $m(7) le chemin de transmission (DATA) $m(7) un tampon (101R)).
États désignés : CN, KR, US.
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR).
Langue de publication : japonais (JA)
Langue de dépôt : japonais (JA)