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1. (WO2002044904) PROCEDE ET DISPOSITIF DESTINES A REDUIRE LE TEMPS D'ATTENTE DANS UN SYSTEME DE MEMOIRE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/044904    N° de la demande internationale :    PCT/CA2001/001686
Date de publication : 06.06.2002 Date de dépôt international : 28.11.2001
Demande présentée en vertu du Chapitre 2 :    01.07.2002    
CIB :
G06F 12/08 (2006.01)
Déposants : MOSAID TECHNOLOGIES INCORPORATED [CA/CA]; 11 Hines Road, Kanata, Ontario K2K 2X1 (CA)
Inventeurs : MEKHIEL, Nagi, Nassief; (CA)
Mandataire : BAKER, Harold, C.; Shapiro Cohen, P.O. Box 3440, Station D, Ottawa, Ontario K1P 6P1 (CA)
Données relatives à la priorité :
2,327,134 30.11.2000 CA
Titre (EN) METHOD AND APPARATUS FOR REDUCING LATENCY IN A MEMORY SYSTEM
(FR) PROCEDE ET DISPOSITIF DESTINES A REDUIRE LE TEMPS D'ATTENTE DANS UN SYSTEME DE MEMOIRE
Abrégé : front page image
(EN)A memory controller controls a buffer which stores the most recently used addresses and associated data, but the data stored in the buffer is only a portion of a row of data (termed row head data) stored in main memory. In a memory access initiated by the CPU, both the buffer and main memory are accessed simultaneously. If the buffer contains the address requested, the buffer immediately begins to provide the associated row head data in a burst to the cache memory. Meanwhile, the same row address is activated in the main memory bank corresponding to the requested address found in the buffer. After the buffer provides the row head data, the remainder of the burst of requested data is provided by the main memory to the CPU.
(FR)Selon l'invention, un contrôleur de mémoire commande une mémoire tampon destinée au stockage des adresses et des données associées les plus récemment utilisées, mais les données stockées dans la mémoire tampon constituent seulement une partie d'une rangée de données (dite rangée de données avant) stockées dans la mémoire principale. Lorsque l'U.C. interroge la mémoire, la mémoire tampon et la mémoire principale sont consultées simultanément. Si la mémoire tampon contient l'adresse demandée, celle-ci commence immédiatement à fournir la rangée de données avant associée à la mémoire cache sous forme de paquet de données. Entre-temps, la même adresse de rangée est activée dans le bloc de la mémoire principale correspondant à l'adresse demandée de la mémoire tampon. Après que la mémoire tampon a fourni la rangée de données avant, la mémoire principale fournit le reste du paquet de données demandées à l'U.C..
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PH, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZM, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)