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1. (WO2002023725) COMPTEUR DE TYPE M/N A DOUBLE ARETE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/023725    N° de la demande internationale :    PCT/US2001/029154
Date de publication : 21.03.2002 Date de dépôt international : 12.09.2001
Demande présentée en vertu du Chapitre 2 :    12.04.2002    
CIB :
H03K 23/68 (2006.01)
Déposants : QUALCOMM INCORPORATED [US/US]; 5775 Morehouse Drive San Diego, CA 92121-1714 (US)
Inventeurs : HALTER, Steven, J.; (US)
Mandataire : WADSWORTH, Philip, R.; Qualcomm Incorporated 5775 Morehouse Drive San Diego, CA 92121-1714 (US)
Données relatives à la priorité :
09/662,080 14.09.2000 US
Titre (EN) DUAL-EDGE M/N COUNTER
(FR) COMPTEUR DE TYPE M/N A DOUBLE ARETE
Abrégé : front page image
(EN)A counter for synthesizing clock signals with minimal jitter. The inventive counter has a first counter stage; a look-ahead circuit input connected to said first counter stage; and a selection circuit for choosing between an output of said first counter stage and an output of said look-ahead circuit as an output of said counter. In the specific embodiment, the first counter stage is adapted to receive a first clock signal having a frequency of N cycles per second and output a second clock signal having a frequency of M cycles per second. The first counter stage includes an accumulator having a rollover point at which an instantaneous count thereof exceeds the value of N-M. The look-ahead circuit determines for a present clock cycle the rollover point for a preceding clock cycle. The look-ahead circuit is a second counter stage adapted to ascertain whether the rising edge or the trailing edge of the second clock signal is closer to the rollover point and output an indication with respect thereto.
(FR)Compteur servant à synthétiser des signaux d'horloge avec une instabilité minimum. Ce compteur possède un premier étage, une entrée de circuit d'anticipation reliée à ce premier étage et un circuit de sélection servant à effectuer une sélection entre une sortie dudit premier étage et une sortie dudit circuit d'anticipation afin de définir la sortie dudit compteur. Dans un mode de réalisation spécifique, le premier étage du compteur est conçu pour recevoir un premier signal d'horloge possédant une fréquence de N cycles à la seconde et pour émettre un deuxième signal d'horloge possédant une fréquence de M cycles à la seconde. Le premier étage comporte un accumulateur possédant un point de renversement au niveau duquel un comptage instantané dépasse la valeur de N-M. Le circuit d'anticipation détermine pour un cycle d'horloge actuel, le point de renversement du cycle d'horloge précédent. Ce circuit d'anticipation consiste en un deuxième étage de compteur conçu pour vérifier si l'arête ascendante ou l'arête descendante du deuxième signal d'horloge est la plus proche du point de renversement, et pour produire une indication concernant cette proximité.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PH, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)