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1. (WO2002014993) APPAREIL EFFICACE DE LANCEMENT ET D'ARRET D'HORLOGE POUR SYSTEME DE TRANSFERT D'HORLOGE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/014993    N° de la demande internationale :    PCT/US2001/014908
Date de publication : 21.02.2002 Date de dépôt international : 09.05.2001
Demande présentée en vertu du Chapitre 2 :    25.02.2002    
CIB :
G06F 1/10 (2006.01), H03L 7/00 (2006.01)
Déposants : ADVANCED MICRO DEVICES, INC. [US/US]; One AMD Place Mail Stop 68 Sunnyvale, CA 94088-3453 (US)
Inventeurs : MIRANDA, Paul, C.; (US).
McMINN, Brian, D.; (US)
Mandataire : APPERLEY, Elizabeth, A.; Advanced Micro Devices, Inc. 5204 East Ben White Boulevard Mail Stop 562 Austin, TX 78741 (US).
PICKER, Madeline M.; Brookes Batchellor 102-108 Clerkenwell Road London EC1M 5SA (GB)
Données relatives à la priorité :
09/637,178 11.08.2000 US
Titre (EN) EFFICIENT CLOCK START AND STOP APPARATUS FOR CLOCK FORWARDED SYTEM I/O
(FR) APPAREIL EFFICACE DE LANCEMENT ET D'ARRET D'HORLOGE POUR SYSTEME DE TRANSFERT D'HORLOGE
Abrégé : front page image
(EN)An efficient clock start and stop apparatus for clock forwarded system I/O. The apparatus may include a buffer (205) coupled to receive incoming data from a data source. The buffer is clocked by a first clock signal (110) that is provided by the data source. the buffer is condigured to store the incoming data in a plurality of sequential lines in response to teh first clock signal. The buffer may be further configured to store a pluratliy of bits in a pluratliy of occupied-bit registers (206). Each one of the pllurality of occupied-bit registers indicates that data is present in a corresponding sequential line in the buffer. The apparatus may further include a clock gate circuit (250) coupled to the buffer and configured to provide a second clock signal. The clock gate circuit may be further configured to start the second clock signal when valid data is present in the buffer and to stop the second clock signal when no data is present in the buffer.
(FR)L'invention concerne un appareil efficace de lancement et d'arrêt d'horloge pour un système E/S de transfert d'horloge. Cet appareil peut comporter une mémoire tampon (205) couplée afin de recevoir des données entrantes d'une source de données. La mémoire tampon est réglée par un premier signal d'horloge (110) fourni par la source de données. La mémoire tampon est configurée afin de stocker les données entrantes dans plusieurs lignes séquentielles, en réponse au premier signal d'horloge. De plus, la mémoire tampon peut être configurée de manière à stocker plusieurs bits dans plusieurs registres occupés par des bits (206). Chaque registre occupé par des bits indique que les données sont effectivement présentes dans une ligne séquentielle correspondante de la mémoire tampon. L'appareil peut également produire un circuit de portail d'horloge (250) couplé à la mémoire tampon et configuré de manière à générer un second signal d'horloge. Le circuit de portail d'horloge peut également être configuré de manière à lancer le second signal d'horloge, lorsque les données correctes sont présentes dans la mémoire tampon et à l'arrêter lorsque ce n'est plus le cas.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)