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1. (WO2002008907) GESTION DE MEMOIRE SEQUENTIELLE A BLOCS MULTIPLES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication : WO/2002/008907 N° de la demande internationale : PCT/US2001/023863
Date de publication : 31.01.2002 Date de dépôt international : 26.07.2001
Demande présentée en vertu du Chapitre 2 : 25.02.2002
CIB :
G05D 11/00 (2006.01) ,G06F 9/46 (2006.01) ,G06F 12/00 (2006.01) ,G06F 13/16 (2006.01)
G PHYSIQUE
05
COMMANDE; RÉGULATION
D
SYSTÈMES DE COMMANDE OU DE RÉGULATION DES VARIABLES NON ÉLECTRIQUES
11
Commande de teneurs
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
9
Dispositions pour la commande par programme, p.ex. unité de commande
06
utilisant un programme emmagasiné, c. à. d. utilisant une unité de stockage interne de l'équipement de traitement de données pour recevoir et conserver le programme
46
Dispositions pour la multiprogrammation
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
12
Accès, adressage ou affectation dans des systèmes ou des architectures de mémoire
G PHYSIQUE
06
CALCUL; COMPTAGE
F
TRAITEMENT ÉLECTRIQUE DE DONNÉES NUMÉRIQUES
13
Interconnexion ou transfert d'information ou d'autres signaux entre mémoires, dispositifs d'entrée/sortie ou unités de traitement
14
Traitement de demandes d'interconnexion ou de transfert
16
pour l'accès au bus de mémoire
Déposants : WEST, Karlon[US/US]; US (UsOnly)
TIMES N SYSTEMS, INC.[US/US]; Bldg. B Suite P 1908 Kramer Lane Austin, TX 78758, US (AllExceptUS)
Inventeurs : WEST, Karlon; US
Mandataire : BRUCKNER, John, J.; Fulbright & Jaworski, Llp 600 Congress Avenue Suite 2400 Austin, TX 78701, US
Données relatives à la priorité :
09/912,83425.07.2001US
60/220,74826.07.2000US
60/220,97426.07.2000US
Titre (EN) MULTIPLE BLOCK SEQUENTIAL MEMORY MANAGEMENT
(FR) GESTION DE MEMOIRE SEQUENTIELLE A BLOCS MULTIPLES
Abrégé :
(EN) Systems and methods are described for multiple block sequential memory management. A method includes: partitioning a block of memory into a plurality of shared memory segments; and providing a processor with accessibility to each of the plurality of shared memory segments. An apparatus includes: a computer system; a block of memory including a pluriel of shared memory segments; and a processor.
(FR) Cette invention se rapporte à des systèmes et à des procédés pour la gestion de mémoire séquentielle à blocs multiples. Ce procédé consiste: à effectuer la partition d'un bloc de mémoire en plusieurs segments de mémoire partagés; et à constituer un processeur doté d'une accessibilité à chacun de ces segments de mémoire partagés. L'appareil faisant l'objet de cette invention comprend: un système d'ordinateur; un bloc de mémoire contenant plusieurs segments de mémoire partagés; et un processeur.
front page image
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EC, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GQ, GW, ML, MR, NE, SN, TD, TG)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)