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1. (WO2002003185) MECANISME DE COMMANDE DI/DT D'UN MICROPROCESSEUR
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication :    WO/2002/003185    N° de la demande internationale :    PCT/US2001/019328
Date de publication : 10.01.2002 Date de dépôt international : 14.06.2001
Demande présentée en vertu du Chapitre 2 :    24.01.2002    
CIB :
G06F 1/28 (2006.01), G06F 1/32 (2006.01)
Déposants : INTEL CORPORATION [US/US]; 2200 Mission College Boulevard, Santa Clara, CA 95052 (US) (Tous Sauf US).
GROCHOWSKI, Edward [US/US]; (US) (US Seulement).
SAGER, David [US/US]; (US) (US Seulement).
TIWARI, Vivek [IN/US]; (US) (US Seulement).
YOUNG, Ian [AU/US]; (US) (US Seulement).
AYERS, David, J. [US/US]; (US) (US Seulement)
Inventeurs : GROCHOWSKI, Edward; (US).
SAGER, David; (US).
TIWARI, Vivek; (US).
YOUNG, Ian; (US).
AYERS, David, J.; (US)
Mandataire : MALLIE, Michael, J.; Blakely Sokoloff Taylor & Zafman, 12400 Wilshire Boulevard, Los Angeles, CA 90025 (US)
Données relatives à la priorité :
09/608,748 30.06.2000 US
Titre (EN) MECHANISM TO CONTROL di/dt FOR A MICROPROCESSOR
(FR) MECANISME DE COMMANDE DI/DT D'UN MICROPROCESSEUR
Abrégé : front page image
(EN)The present invention provides a mechanism for adjusting the activity of an integrated digital circuit such as a processor to reduce voltage changes attributable to current changes triggered by clock gating. The processor includes one or more functional units and a current control circuit that monitors activity states of the processor's functional units to estimate the current consumed over n clock cycles. The current control circuit estimates the current change for a given clock cycle from the n activity states and compares the estimated current change with first and second thresholds. The processors activity is decreased if the estimated current change is greater than the first threshold, and the processor activity is decreased if the estimated current change is less than the second threshold.
(FR)L'invention concerne un mécanisme de réglage de l'activité d'un circuit intégré numérique, tel qu'un processeur, ce mécanisme étant conçu pour réduire les changements de tension causés par les changements de courant produits par le déclenchement de l'horloge. Ce processeur comprend au moins une unité fonctionnelle ainsi qu'un circuit de commande de courant, lequel surveille les états d'activité des unités fonctionnelles du processeur, afin d'estimer le courant consommé pendant n cycles d'horloge. Le circuit de commande de courant estime le changement de courant pendant un cycle d'horloge donné, à partir des n états d'activité et compare le changement de courant estimé avec des premier et second seuils. L'activité du processeur est diminuée si le changement de courant estimé est supérieur au premier seuil et elle est également diminuée si le changement de courant estimé est inférieur au second seuil.
États désignés : AE, AG, AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, BZ, CA, CH, CN, CO, CR, CU, CZ, DE, DK, DM, DZ, EE, ES, FI, GB, GD, GE, GH, GM, HR, HU, ID, IL, IN, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LU, LV, MA, MD, MG, MK, MN, MW, MX, MZ, NO, NZ, PL, PT, RO, RU, SD, SE, SG, SI, SK, SL, TJ, TM, TR, TT, TZ, UA, UG, US, UZ, VN, YU, ZA, ZW.
Organisation régionale africaine de la propriété intellectuelle (ARIPO) (GH, GM, KE, LS, MW, MZ, SD, SL, SZ, TZ, UG, ZW)
Office eurasien des brevets (OEAB) (AM, AZ, BY, KG, KZ, MD, RU, TJ, TM)
Office européen des brevets (OEB) (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Organisation africaine de la propriété intellectuelle (OAPI) (BF, BJ, CF, CG, CI, CM, GA, GN, GW, ML, MR, NE, SN, TD, TG).
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)