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PATENTSCOPE

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1. (WO2001080220) APPAREIL ET PROCEDE DE DETECTION D'ACTIVITE VOCALE
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication : WO/2001/080220 N° de la demande internationale : PCT/IB2001/001603
Date de publication : 25.10.2001 Date de dépôt international : 14.03.2001
Demande présentée en vertu du Chapitre 2 : 30.07.2001
CIB :
G10L 25/78 (2013.01)
Déposants : SHAHAF, Mark[IL/IL]; IL (UsOnly)
BEN-SHIMOL, Yishay[IL/IL]; IL (UsOnly)
SHOR-HAHAM, Moti[IL/IL]; IL (UsOnly)
MOTOROLA ISRAEL LIMITED[IL/IL]; 16 Kremenetski Street 67899 Tel Aviv, IL (AllExceptUS)
Inventeurs : SHAHAF, Mark; IL
BEN-SHIMOL, Yishay; IL
SHOR-HAHAM, Moti; IL
Représentant
commun :
MOTOROLA ISRAEL LIMITED; c/o Motorola European Intellectual Property Operations Midpoint, Alecon Link Basingstoke Hampshire RG21 7PL, GB
Données relatives à la priorité :
0006312.315.03.2000GB
Titre (EN) VOICE ACTIVITY DETECTION APPARATUS AND METHOD
(FR) APPAREIL ET PROCEDE DE DETECTION D'ACTIVITE VOCALE
Abrégé :
(EN) Voice activity detection system including a plurality of audio parameter delay units connected in series therebetween, the first audio parameter delay unit being further connected to an audio parameter generator, a plurality of distance measure units, each connected to at least two of the delay units, and averaging unit, connected to the distance measure units, a plurality of averaging delay units connected in series therebetween, the first averaging delay unit being further connected to the output of the averaging unit, and a digital logic unit connected to the averaging delay units.
(FR) L'invention concerne un système de détection d'activité vocale comportant plusieurs circuits de retard à paramètre audio connectés en série entre eux. Le premier des ces circuits est également connecté à un générateur à paramètre audio, à plusieurs circuits de mesure distants, chacun d'eux étant connecté à au moins deux des circuits de retard, et un circuit de moyennage, connecté aux circuits de mesure distants, plusieurs circuits de retard de moyennage connectés en série entre eux. Le premier de ces circuits de retard de moyennage est également connecté à la sortie du circuit de moyennage et à un circuit de logique numérique connecté aux circuits de retard de moyennage.
États désignés : AL, AM, AT, AU, AZ, BA, BB, BG, BR, BY, CA, CN, CU, CZ, EE, GE, GH, GM, HR, HU, ID, IL, IS, JP, KE, KG, KP, KR, KZ, LC, LK, LR, LS, LT, LV, MD, MG, MK, MN, MW, MX, NO, NZ, PL, RO, RU, SD, SG, SI, SK, SL, TJ, TM, TR, TT, UA, UG, US, UZ, VN, YU, ZW
Office européen des brevets (OEB (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)