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1. (WO2001079990) UNITE DE TRAITEMENT DE SIGNAL MIXTE PRESENTANT DES CARACTERISTIQUES DE DISTORSION ET DE BRUIT AMELIOREES
Dernières données bibliographiques dont dispose le Bureau international   

N° de publication : WO/2001/079990 N° de la demande internationale : PCT/US2001/012559
Date de publication : 25.10.2001 Date de dépôt international : 17.04.2001
Demande présentée en vertu du Chapitre 2 : 13.11.2001
CIB :
G06F 7/64 (2006.01) ,H03M 3/00 (2006.01)
Déposants : TRIPATH TECHNOLOGY, INC.[US/US]; Suite 200 3900 Freedom Circle Santa Clara, CA 95054, US
Inventeurs : DELANO, Cary, L.; US
Mandataire : OLYNICK, Mary, R.; Beyer Weaver & Thomas, LLP P.O. Box 778 Berkeley, CA 94704-0778, US
Données relatives à la priorité :
09/836,62216.04.2001US
60/198,11117.04.2000US
Titre (EN) MIXED SIGNAL PROCESSING UNIT WITH IMPROVED DISTORTION AND NOISE CHARACTERISTICS
(FR) UNITE DE TRAITEMENT DE SIGNAL MIXTE PRESENTANT DES CARACTERISTIQUES DE DISTORSION ET DE BRUIT AMELIOREES
Abrégé : front page image
(EN) A mixed signal processing unit with non-linear feedforward paths (36, 38) to improve total harmonic distortion 'THD' and noise characteristics of the processor. Specifically the processor includes a first integrator stage (14) configured to receive an input signal and configured to generate a first integrated signal in response thereto, a second integrator stage (16) coupled to the first integrator stage (14) and configured to generate a second integrated signal from the first integrated signal, a sampling stage (22) coupled to the second integrator stage (16) and configured to sample the second integrated signal received from the second integrator stage (16) at a sample frequency and to generate a logic signal, and a non-linear feed-forward path (36, 38) coupled between the first integrator stage (14) and the sampling stage (22).
(FR) La présente invention concerne une unité de traitement de signal mixte présentant des trajets non linéaires avec réaction vers l'avant (36, 38), permettant d'améliorer la distorsion harmonique totale (THD) et les caractéristiques de bruit du processeur. Particulièrement, le processeur comprend un premier étage intégrateur (14) conçu pour recevoir un signal d'entrée et produire un premier signal intégré en réponse à celui-ci, un second étage intégrateur (16) couplé au premier étage intégrateur (14) et conçu pour générer un second signal intégré provenant du premier signal intégré, un étage d'échantillonnage (22) couplé au second étage intégrateur (16) et conçu pour échantillonner le second signal intégré reçu du second étage intégrateur (16) à une fréquence d'échantillonnage donnée et produire un signal logique, et un trajet non linéaire avec réaction vers l'avant (36, 38) couplé entre le premier étage intégrateur (14) et l'étage d'échantillonnage (22).
États désignés : CA, CN, JP, KR
Office européen des brevets (OEB (AT, BE, CH, CY, DE, DK, ES, FI, FR, GB, GR, IE, IT, LU, MC, NL, PT, SE, TR)
Langue de publication : anglais (EN)
Langue de dépôt : anglais (EN)